PCINLIFE：英特尔Tera级别处理器架构图全球抢先曝光

只看该作者 · 发表于 2006-9-28 13:53

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Edison · 发表于 2006-9-28 13:58

目前这个东西根据介绍还只是FP簇，能不能跑视频编码还是个很大的问题，毕竟视频编码不仅仅是DCT。

只看该作者 · 发表于 2006-9-28 14:02

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ximimi · 发表于 2006-9-28 14:11

原帖由 RacingPHT 于 2006-9-28 13:53 发表

你完全错了.

集成显卡可以做Linpak吗? 可以算PI吗? 可以让视频编码速度提高数十倍吗? 可以任意做CPU擅长的事情吗? 不行。
这个many core, 可是货真价实的CPU core, 想做什么都可以。本质不同了。

Inte ...

cpu发展到头了就只好搞多功能了

他是代替低端显卡

不是代替u

当然可以做这些

那个时候的显卡说不定把sharder都分出来，通用化了

只要是浮点都可以作
完全可编程

只看该作者 · 发表于 2006-9-28 14:33

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ximimi · 发表于 2006-9-28 14:35

原帖由 RacingPHT 于 2006-9-28 14:33 发表

这招其实我觉得蛮厉害.
至于显卡的shader的通用化, 只要你了解GPU的流水线结构, 就大概会同意, 它和性能相近的core相比完全没有竞争力可言.

与PC上应用面越来越窄的高端GPU相比, 我觉得many core的杀伤力 ...

如果你认为sharder会朝cpu方向发展当然会认为和core比没优势

但是如果他作为另外一种通用的fpga，和cpu争夺同等地位，未必就不是对手了

cpu有累赘

只看该作者 · 发表于 2006-10-2 09:34

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Edison · 发表于 2006-10-2 09:42

原帖由 potomac 于 2006-10-2 09:34 发表

这个bus没看懂。有没有这次IDF的完整PDF下载？:unsure:

ftp://download.intel.com/researc ... /terascale_demo.htm

只看该作者 · 发表于 2006-10-2 09:52

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只看该作者 · 发表于 2006-10-3 12:11

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Edison · 发表于 2006-10-5 16:37

其实只要有合适容量的cache，目前的CPU都可以以0.25 byte/cycle per flop（stream/linpack)的带宽支撑起来。

http://www.pcinlife.com/article/ ... 59207275d221_8.html

只看该作者 · 发表于 2006-10-5 17:36

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R620 · 发表于 2007-2-11 11:16

原帖由 RacingPHT 于 2006-10-3 12:11 发表
单纯图形性能, 这个东西肯定不如专用电路的, 虽然以后flops可能差距不会太大, 但是很多东西, 比如硬件filter, interpolator, MSAA unit, 隐藏延迟的TMU hardware thread, CPU都不好实现。GPU的高端需求, 肯定是 ...

关键是GPU的高端需求所获得的利润能否支持GPU厂商的可持续发展所必须的资金呢？:funk:

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