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标题: Conroe的L2关掉性能会下降多少?有没人试过?? [打印本页]

作者: LosKenya 时间: 2009-5-5 00:08
标题: Conroe的L2关掉性能会下降多少?有没人试过??
　　记得很早以前用c633的时候,同学来我家在我电脑上做手脚，把Ｌ２关了．结果性能下降的并不是特别明显，甚至一度我还没觉察出有什么问题，只是感觉好象稍微慢了一点．居然就这么一直用了半年，要不是后来玩ＮＢＡ２０００，和别人同样的配置我的明显比他卡，觉得不对，才在ＢＩＯＳ里发现Ｌ２被关了的话，可能就这么傻乎乎地一直用下去了

　　在用CeleronD2.4的时候，自己又试验了一次。乖乖，不得了了！过了１０多分钟才见到WINDOWS滚动条出现，１０几秒滚不了一下，然后越来越慢，滚动条滚着滚着就停那了，也不知道是假死还是其他的问题。半个多小时过去了还没出现登陆窗，实在没耐心了，ＲＳＴＡＲＴ，ＢＩＯＳ里调回去，不玩了！！！

　　都说Conroe核心执行效率超高，那么关掉Ｌ２的话情况又会如何呢？？是像C633那样用了好一阵子还觉察不出来，还是像CeleronD那样一上来就彻底把人折磨的没脾气？？还是介于二者之间？？有人试过吗？？？我也不知道现在的主板还有没关闭Ｌ２的功能，我自己的IP35-E似乎没有

　　　

作者: 拳头 时间: 2009-5-5 00:40
多和少差别不明显，有和没有差别就大了，赛扬300A的时候就是如此，不过还不至于让你察觉出发牌和扫雷速度的变化吧，游戏如果是3D的，也会怀疑显卡不够猛

作者: mya1001 时间: 2009-5-5 04:11
你试试把L1关了~~~~~

作者: 潇潇红叶 时间: 2009-5-5 10:13
本帖最后由潇潇红叶于 2009-5-6 12:05 编辑

二级缓存是CPU和内存交换数据的一个缓冲区，目的是减少速度瓶颈。

"自P4时代开始，Intel开始采用全新的“数据代码指令追踪缓存”设计。基于这种架构的一级数据缓存不再存储实际的数据，而是存储这些数据在二级缓存中的指令代码（即数据在二级缓存中存储的起始地址）。假设处理器需要读取“INTEL P4 IS GOOD”这一串数据（不记空格），那么所有数据将被存储在二级缓存中，而一级数据代码指令追踪缓存需要存储的仅仅是上述数据的起始地址."

上面引用的大概意思是如果关掉二级缓存，一级数据缓存也就没有意义了。所以目前INTEL的CPU,关掉二级缓存无异于自杀。

自己用过E4300(2M二级缓存，OC 333*9)、E8400(6M二级缓存，OC 450*9)，同样的主板、显卡及3D游戏配置，前者FPS（1~200）,后者FPS（20～600）。

06年用478平台的时候深有体会，CD325（256K缓存 OC 190×19）＋ 865主板＋ X800GTO玩CS1.6，人多的时候FPS也会掉到70左右而且屏幕抖动厉害，后来换了个P4 3.0E（1M缓存默认200×15）,人数再多FPS也一直稳定在99，非常流畅。

作者: Asuka 时间: 2009-5-5 10:19
关掉的话，性能会回到10年前x86处理器的水平

作者: xeon-pan 时间: 2009-5-5 10:19
cpu是一个整体，cpu对有没有L2都无所谓，那么说明他的L2命中率不高而已

作者: libotty06 时间: 2009-5-5 10:53
本帖最后由 libotty06 于 2009-5-5 10:57 编辑

L2影响最小的是K7,当年把2000+的L2关了,跑起分来还是有原来的八成多功力(显卡是4200,关之前01跑10000,关了之后跑8500),游戏里灭2.8G的C4相当轻松

作者: lobbiest 时间: 2009-5-5 11:12
intel跟amd架构不一样，amd关L2之后L1还能顶着用一下，找不到的东西再访问内存，所以还是可以接收的。
intel从P4开始的L1都是追踪缓存，只存一个指令和数据在L2里面的地址，实际数据还是在L2里面，所以关了之后就一点缓存不剩了，全部访问内存，相当于自杀。

作者: b22sun 时间: 2009-5-5 11:36
酷睿架构和P4又不同了吧追踪缓存消失了 L1还是有点数据的

作者: itany 时间: 2009-5-5 12:07

intel跟amd架构不一样，amd关L2之后L1还能顶着用一下，找不到的东西再访问内存，所以还是可以接收的。
intel从P4开始的L1都是追踪缓存，只存一个指令和数据在L2里面的地址，实际数据还是在L2里面，所以关了之后就一 ...
lobbiest 发表于 2009-5-5 11:12

看来当年的胡扯党人还是影响很大啊，至今还有人没有想明白
P4的L1D里边还是存放操作数的，根本不是什么地址；L1I是追踪缓存，里边存放的是译码之后的指令，也就是微操作，也不是什么地址

关键的问题就是，P4的L1D缓存比较小，只有8KB，所以命中率比较低，经常要访问L2缓存，这一点Athlon的L1D就大得多（好像是64KB），而L2比较小，所以对L2的依赖也比较小
另外一个，P4的译码器是放在L1I和L2之间的，这样也加重了对L2的依赖

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