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标题: 关于多DAC并联的一些问题，请高手解答 [打印本页]
作者: 酷风    时间: 2007-12-10 14:36
标题: 关于多DAC并联的一些问题，请高手解答
在多DAC并联之后，会带来哪些好处？5 Y4 ?' A5 P9 y  t/ W. h, Y
我记得有人说过并联之后会降低jitter值，除此以外还有其他的影响吗？5 a1 r8 u( \/ _  i& n- u7 h
输出的信号强度会不会有变化？4 d+ E& L' _. y, j
我指的是vrms的值，电压在并联之后会不会有所提升
作者: fineday    时间: 2007-12-10 14:46
好处啊，线路比较烂的DAC可以得到更高的信噪比啊、动态范围啊之类:p
6 C% G, \; c* A0 `3 d3 B4 \前提是线路比较烂哦～
作者: kim.lee    时间: 2007-12-10 14:46
不懂，来看答案:a)
作者: zifzhu    时间: 2007-12-10 15:48
应该是THD吧。jitter是时序的问题，应该和DAC芯片无关。Vrms也不会有变，并联吗，一个2.6v和一个2.4v并一起不能得到5v的。同样，也不会是2.5。因为不管什么输出级，拉低和拉高的电流是不一样的，而且一般都还相差蛮大的，不过总归会靠近2.5一些，所以多少还是有些效果的。并联就像现在的SLI一样，实在是用了最好的芯片还不够才这样做，7600gt再怎么SLI也比不过8800ultra的。建议还是用一个好一点的芯片就行了。
作者: chairmanai    时间: 2007-12-10 16:23
浅谈音频DAC的特殊用法
二、并联法
0 x  z/ `! M& _% \并联使用DAC可提高等效比特数，提高转换精度，还原音乐的厚度感和力度感增强，在DAC的其他用法中，也可再施加此法，效果显著，因此它在高档机中获得了广泛的应用。: F5 [' T- ]# m) X- D
+ c, o6 x5 t. d6 Q1 [
[attach]812271[/attach]& a0 t7 n, H1 T6 ?
原理见图2（a）所示。n个DAC并联同步工作，将n个DAC输出的电流信号相加，再经过电流/电压（I/V）变换，输出模拟电压信号。
3 {3 J) r1 I% j9 L/ K这种方法对小信号处理能力明显增强，等于增加了DAC的比特数。例如，2个18 bit DAC并联后的转换精度相当于19 bit，4个20 bit DAC并联后转换精度相当于23 bit ，而8个20 bit DAC并联后转换精度相当于24 bit，等等。PCM1704等24 bit DAC出现之前，高档数字音响的24 bit转换精度就是利用多个DAC并联方法得到的。- X/ D4 D/ |( V' n
当DAC并联使用时，信噪比、动态范围都会提高，而失真度将会减小，各种误差也被平均化而降低。! D+ ~* y( {" d1 I. H0 Q5 @& K
例如，对4个性能一致的20 bit DAC芯片进行并联实验，分别对1个、2个并联、3个并联、4个并联的信噪比（SNR）、总谐波失真（THD）、动态范围（DR）进行测试，测试的结果分别见图2（b）、图2（c）和图2（d）所示。
. V- N. y- t+ M; f3 T% q从图2（b）的信噪比（SNR）特性测试图可以看出，随着DAC并联数目的增加，信噪比明显增加，由单个的115.8dB增加到2个并联的117dB、3个并联的119.2dB和4个并联的120.7dB。# c( @, i( G8 x" n: O+ u
从图2（c）的总谐波失真（THD）特性测试图可以看出，随着DAC并联数目的增加，总谐波失真也有降低，由单个的0.0024%降低到2个并联的0.0019%、3个并联的0.0016%、4个并联的0.0014%。+ r+ M; r8 E: `" x; g2 y. U( V6 M
从图2（d）的动态范围（DR）特性测试图可以看出，随着DAC并联数目的增加，动态范围也在提高，由单个的100.5dB增加到2个并联的101dB、3个并联的101.3dB、4个并联的101.5dB。
( f3 b( k1 w/ s2 ~/ I/ ]. \[attach]812272[/attach]
' m/ x' w- o/ \# W
/ ~" O$ y. X# L2 A+ A " y& v0 p7 e4 A
详细内容可以去这里看看：
' W7 x' |8 t* R7 I; u' c8 r0 Lhttp://www.audio-gd.com/audio/two/new_page_18.htm0 Z0 B: }# F0 C" }7 t, H
http://www.go-gddq.com/html/2006-10/407373.htm: U$ [3 W, |7 v: l$ m, S4 W/ h
作者: 一生相随    时间: 2007-12-10 16:34
原帖由 chairmanai 于 2007-12-10 16:23 发表
* Q  r: l$ ~  g$ G4 d& d浅谈音频DAC的特殊用法二、并联法
( V5 R6 _# [) Y并联使用DAC可提高等效比特数，提高转换精度，还原音乐的厚度感和力度感增强，在DAC的其他用法中，也可再施加此法，效果显著，因此它在高档机中获得了广泛的应用。
$ l* o5 m9 K0 R  v" K
. {+ @$ U2 o- l) |* L2 t812271
1 z2 q: v4 L1 n9 T! Y, E# [) U( k8 [原理 ...
9 M+ N5 j& j; o' J, b+ I
audio-gd:rolleyes:
' M& v, n. \* S, k2 o; y5 X) s我就是请教了这个老板后才去尝试并联DAC的-_- 他比较空闲的时候还是很有耐性的:shifty: 2 {$ N& Y3 U* z8 t$ @" q3 e; D
作者: chairmanai    时间: 2007-12-10 16:37
原帖由 一生相随 于 2007-12-10 04:34 PM 发表 * X& w. N( `  N& x1 U

5 Q2 T3 U" H3 b" \audio-gd:rolleyes: 0 u8 b) N8 u6 Z5 G! D" e( h5 N8 ]
我就是请教了这个老板后才去尝试并联DAC的-_- 他比较空闲的时候还是很有耐性的:shifty:

$ `0 L. v8 `; Q. M' d
/ D2 y% _- `& |1 a% d他在土炮界也算小有名气了:lol:
作者: zifzhu    时间: 2007-12-10 16:38
原帖由 chairmanai 于 2007-12-10 16:23 发表 4 a; c, s! y$ ~  T* w6 G: ~9 |
浅谈音频DAC的特殊用法二、并联法
4 U* ?# F# x" c9 M$ t并联使用DAC可提高等效比特数，提高转换精度，还原音乐的厚度感和力度感增强，在DAC的其他用法中，也可再施加此法，效果显著，因此它在高档机中获得了广泛的应用。
: D: X. ^4 j* ^' Z: ?, l1 U' h: |7 O# y
812271
% U0 m* H6 W8 M7 B原理 ...

: M" J* o3 B% V0 ]: S8 G5 N就是搞不懂为什么会提高bit数。信号源就就是那么多bit，DAC哪里去自己加几个bit呢？除非信号源是高bit的，比如20bit。DAC是低bit的，比如18bit。那么信号源就可以分配四个不同的数据到四个DAC后并联取平均值。比如- y  s' v8 h6 z  }2 h1 V
20bit:    000000000000000001 可以这么分配
0 S. q+ _1 _/ J. I/ |18bit_0: 0000000000000001
5 w* ^8 ]7 J* c* A* x5 X18bit_1: 0000000000000000* K; T! d" }7 p* g
18bit_2: 0000000000000000
# J0 f' x2 Q% z5 z/ T- x18bit_3: 0000000000000000
; V  J5 r# B" U# D- g3 P% `5 L这样就是20bit了，因为输入是不同的，所以输入不能并联起来，要做这个动作还是蛮复杂的，除非自己写FPGA来做，现成的IC一般都不会有这种功能。
作者: 一生相随    时间: 2007-12-10 16:48
弄的越来越复杂了:sweatingbullets: 还是我的一托锡简单，就这样并了，引用别人的话:shifty: 谁用谁知道-_-
作者: chairmanai    时间: 2007-12-10 16:51
其实提高bit数那一段我也看得不是一般纳闷:sweatingbullets:
作者: flz821028    时间: 2007-12-10 17:07
原帖由 chairmanai 于 2007-12-10 16:23 发表 1 {' O0 q) p# F, C9 Z( ?, h, S8 L
浅谈音频DAC的特殊用法二、并联法( {+ Q% K0 i7 x+ e" i
……
  Q4 d" [, w7 p; }. L4 F……
5 ]& O6 n' Z  R* \例如，2个18 bit DAC并联后的转换精度相当于19 bit，4个20 bit DAC并联后转换精度相当于23 bit ，而8个20 bit DAC并联后转换精度相当于24 bit，等等……
5 t$ y5 ~; O- t( s1 ?" |! w
鸡蛋里挑点骨头:loveliness:   貌似应该是“4个20 bit DAC并联后转换精度相当于22 bit ，而8个20 bit DAC并联后转换精度相当于23 bit”
作者: 酷风    时间: 2007-12-10 18:03
看来并联的好处多多呀！:w00t):
作者: caojy    时间: 2007-12-10 23:11
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作者: 酷风    时间: 2007-12-11 10:55
原帖由 caojy 于 2007-12-10 23:11 发表
# T1 u: V+ }8 Z0 O9 F) o  N5楼的回答是抄电子报的，还把它的错误一样抄来。
2 |/ L: W( [6 u7 O1 G; T
什么错误？能不能说一下？
作者: flz821028    时间: 2007-12-11 12:23
原帖由 酷风 于 2007-12-11 10:55 发表
! y- \2 N5 m$ ^' m- U# o. Q3 p
9 D2 F: B) D( G/ j什么错误？能不能说一下？
# I1 n. `7 A  z+ M/ |7 u& y- y
貌似就是我11楼说的那个吧？:unsure:
作者: HerculesVR    时间: 2007-12-11 12:28
DAC 电路并联，没有一个好时钟 那基本就是劣化音质···
作者: gz0921    时间: 2007-12-11 12:40
提高比特数其实道理很简单，可以拿两个并联的情况来说明。: W4 S$ z$ h6 G& C; q& X$ L4 f9 \

, u# J+ ]- y) b: S: j+ i比如输入信号是17bit的，去掉符号位，为16bit，那么使用两个16bitDAC，用输入数据的符号位做数据选通信号，整数时送给一个DAC，负数时送给另外一个DAC，二DAC输出的参考分别接正负基准源，再用差分运放将两DAC的输出合成，那么就相当于用两个16bitDAC达到一个17bitDAC的精度了。
' ^3 B* P: G( Z/ _
; c. m- }6 n6 g5 |依次类推，合并两组这种结构，就有18bit精度～
作者: zifzhu    时间: 2007-12-11 13:10
原帖由 gz0921 于 2007-12-11 12:40 发表
5 x( S9 |) N% L. a% O提高比特数其实道理很简单，可以拿两个并联的情况来说明。& q$ Q, u9 n( i% b9 v" ]  l0 h* r

+ I$ g# E$ N5 R2 C. H比如输入信号是17bit的，去掉符号位，为16bit，那么使用两个16bitDAC，用输入数据的符号位做数据选通信号，整数时送给一个DAC，负数时送给另外一个DAC， ...
1 E* ~* j- _1 ?2 N5 y" f
很大一部分的DAC都是串行总线的。所以去分割bit位不是加几个门电路就能解决的，要自己写FPGA。所以个人对提高比特数这个说法还是持保留态度。
作者: 酷风    时间: 2007-12-11 13:43
原帖由 HerculesVR 于 2007-12-11 12:28 发表
: Z2 q. P" U1 O! V5 N7 N, C/ LDAC 电路并联，没有一个好时钟 那基本就是劣化音质···
* k8 [, Y8 v) P6 d
看来下一步就是要换个精度更高的晶振了……
作者: terryddb    时间: 2007-12-11 14:25
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作者: HerculesVR    时间: 2007-12-11 15:25
标题: 回复 20# 的帖子
我可给你OEM 时钟模块:lol: 1 o5 x: \& \' {; K/ G

' s" @# k! d+ D% G9 u: y晶振只是一般部分，后期频率调制也很重要！^^:loveliness:
作者: gz0921    时间: 2007-12-11 15:50
原帖由 zifzhu 于 2007-12-11 13:10 发表
! |1 N0 M. N, h: m
" z- f/ x6 F3 V/ ?很大一部分的DAC都是串行总线的。所以去分割bit位不是加几个门电路就能解决的，要自己写FPGA。所以个人对提高比特数这个说法还是持保留态度。
! l4 w0 }2 J- c3 e

# b. `3 Z. E3 R) e8 K) Z叫个电子工程师就应该会用PLD吧，哪个厂商的RD这么差，连PLD都不会用？:w00t):
作者: gz0921    时间: 2007-12-11 15:58
原帖由 酷风 于 2007-12-11 13:43 发表
) U5 P, u  L. W) u$ l
9 x( u  w8 V6 L6 z& B1 U6 N, @# g4 Y看来下一步就是要换个精度更高的晶振了……
7 X6 [0 p% B5 p! @
8 l& ]8 D" Y; M
对于ADC、DAC来说，影响SNR和THD+N的东西简直太多了～
  V; O1 l# ]. R
3 M& O& _. c6 @8 E% p% m8 r4 \时钟是一个，时钟的频谱纯度，相位噪声，频率稳定性，都是重要的决定条件。7 e9 [& f, g+ G! o7 p! @. O
: V1 |; y; b$ Z$ s
电源也是尤为重要的一环，所有的ADC和DAC都应该被当成模拟器件对待，他们的电源必须非常纯净，要尽量与数字电路的开关噪声隔离。' i6 ^5 s  c+ P$ K
' K6 d- a; F4 y: `4 \8 h$ P! @) E& i
对于高速ADC、DAC来说，电源平面或者地平面也要为信号提供最短的回流路径以减小信号环流带来的噪音和EMC问题。
% W  h9 `1 A% {6 S% `* i% z. R6 W1 R9 t( Q# h% h
这些都要求在元件选择上和PCB设计上下功夫：  ]7 s. X4 X" G$ p* r" u
要选择带电压补偿或者温度补偿的晶体振荡器；
$ Q! Z) K# m- _  H5 t: l- ~必须使用4层或者4层以上PCB，有点在于这样有利于电源分区设计，并且能提供完整的地平面。
  G/ z: T& ?2 B) ~7 k等等等等。。。。
作者: zifzhu    时间: 2007-12-11 16:56
原帖由 gz0921 于 2007-12-11 15:50 发表 ( z9 B: r/ E! o6 h% ?( r( S

( N8 H8 l6 G3 E- A- N% O8 q: u5 @. y; t" Y) ]0 _- Y* I) ~
叫个电子工程师就应该会用PLD吧，哪个厂商的RD这么差，连PLD都不会用？:w00t):

- j+ d7 B; h% d4 x  R# s
. u+ \! d, w; ]# ~2 [你太高估音频行业的电子工程师的水平了，特别是国内的:p * I4 U" v# y  R8 |
去看看电子报就知道了。
作者: gz0921    时间: 2007-12-11 17:13
呵呵，是你太低估了，这种程度的PLD开发其实十分简单，只要想用就能用，根本不存在技术壁垒～
作者: HerculesVR    时间: 2007-12-11 17:40
1：! X9 A  q. S/ r" r' S/ M
CPLD 就算了吧，虽然我不怎么懂数字，但是我的朋友告诉我只要我不不嫌麻烦，理论上我用门就能做CPLD。但是FPGA 跟CPLD不是一个概念，难多了。简单说你找一个CPLD工程师干活一个小时1RMB，但是FPGA工程师就要10RMB甚至更多。, h0 z3 W5 B7 G9 e, k
7 o- A0 G: b, W, d8 o
2：% g: j) M8 l# L* r, o
计时器只是一个参考，主要决定品质的是jitter，决定jitter的是相位噪音，决定相位噪音的是温度系数（我说的比较笼统），宗旨每个环节都重要。参考时钟有条件当然用OCXO以上啦。频率调制就是第二个问题，DDS 和PLL 都可以（我更喜欢PLL，毕竟音频时钟不是路由器，不需要用DDS乱跑频）
; D) G( d  C# q: Z+ L7 Q8 x
( y  y4 p& n8 l! D3：$ m5 o. J' Z0 S6 o
电源属于没有办法的办法，-80dB相对容易，-90dB电源造价就是-80dB的平方，-100dB基本上再平方，-110dB就还是一个平方-120dB 再生电源系统 ，再好的商业级就没见过了······所以电源这个东西是根据预算和体积来好了3 b) O, l4 w: Q+ ]+ |+ `% @8 G6 V

0 z* z+ t7 v# r4：" ^  `: |* Q, E0 Y+ G  a2 x# Y9 d. ?
最后就是layout，同时精通模拟电路和数字电路（混合电路布线），好像的确做DVD什么的比较多，尤其90年代中期那些深圳开始做layout的老powerpcber，只要找对人，绝对没问题！layout算是经验活，大陆做布线可绝对不必老外差！
. M! ^8 C6 H1 K- k1 W1 I$ E
) A0 w. r8 F  j2 {. `9 f, j5：
# |) Z: a6 F5 i- X4 o0 `7 XADC DAC 现在音频大多是西格玛德尔塔方式，所以购用就好了。一般ADCDAC的layout 之tip官方 PDF写的明明白白。. @. S% |- B" {/ W: L7 D
缓冲电路的确值得研究！
作者: zifzhu    时间: 2007-12-11 18:26
原帖由 gz0921 于 2007-12-11 17:13 发表
) L8 f; l$ F+ R4 c" B呵呵，是你太低估了，这种程度的PLD开发其实十分简单，只要想用就能用，根本不存在技术壁垒～

7 g5 `& R! n1 k7 b! p- j; t我没有低估啊。前几天我四处找用FPGA模拟一个I2C eeprom的VHDL代码。因为我想用FPGA模拟24C32给USB的控制器用，这样可以节省一个24c32。可在网上找了n久就是没找到一个。就算有也是不可以综合的。最后还是要我自己写。% |8 I" S, ]! s$ s. f: e
这两天又在找cy7c68013的avalon接口代码，也是无功而返。
/ x2 G1 f( S1 s' r7 t7 r5 a这些都是极为常用的器件了，都是这个样子。可想而之水平如何。
. l; |) m" L. o+ {; n, F
4 T3 _+ l8 Q* |要解析和模拟I2S必须要写状态机。国内学FPGA的90%都是学生应付考试的。能独立写状态机的已经是高手了。去edacn上去看看好了，水平之低，连我都不好意思说。更何况音频工程师绝大部分都是搞模拟电路出生的。要他们去写一个？还是下辈子吧。
7 K/ G4 W  ]4 ?- o/ ~6 Y1 B
# K1 I" q; c+ w- B* g不要怪我刻薄，现状如此，我只是反映现实问题而已:huh:
作者: gz0921    时间: 2007-12-11 18:45
。。。。。。
: P( ~4 [) J- V% c# Q" X2 W* k我也是一个电子工程师，看到上面的帖子真是无语了～. r2 U" i. s6 r* q
- P7 o" C) h, z1 s, o; x; P. d+ e
你举的那两个例子，老实说真的是非常非常的基础，我想可能是太基础了，所以才没有现成的代码。可能是环境不同吧，国内的电子工程师我想不至于到你说的那个程度，至少我周围的人不至于～呵呵～
) P7 Q+ ]; l- \6 s$ c; X另外，上面说FPGA跟CPLD不一样的那位，现在CPLD从规模上看肯定是比不上FPGA了，但是二者开发流程是一模一样的，并不是说FPGA就比CPLD高一大块了。就此例用到的这个功能而言，CPLD也足以胜任了～, @/ o( w4 X- }3 o5 ]8 I- e
7 y6 C/ }0 d9 k% S  \, |3 h
另外，我之前帖子说的是PLD，是所有可编程逻辑器件的总称，并不是特指CPLD～
作者: 快乐888    时间: 2007-12-11 18:51
好题目，也让学习学习、
作者: HerculesVR    时间: 2007-12-11 19:00
标题: 回复 29# 的帖子
FPGA现在的很多已经需要进行算法编写了，单纯PLD器件绝对是不能根FPGA抗衡啦···至少我问人FPGA已经不是单纯逻辑器件了，工功能和难度来说都上升了好多乜···
- B- j: \0 Z2 h& T& m9 M3 x
4 x/ p6 {) {8 v. p, L( o& K' N& A现在能把PLL.Performance.Simulation.and.Design.Handbook.3rd.Edition看明白的都人不多，这个还是基础:loveliness: & H0 d' ~+ M. d7 \- C
' u% z$ |- P7 r/ W6 y8 T' Q
我想音频电路用PLD的只有控制继电器电路吧··至少我是这样，其余都是用FPGA+DSP····7 v/ {, y! v! Z. C

; e3 Q/ C1 j0 Q. K我是技工，不是工程师，比较肤浅，见笑了 ····
作者: ikinari    时间: 2007-12-11 19:03
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作者: Timme    时间: 2007-12-11 19:04
5楼的其实是串联不是并联...
作者: HerculesVR    时间: 2007-12-11 19:07
标题: 回复 32# 的帖子
太阳你Y的····
作者: gz0921    时间: 2007-12-11 19:10
原帖由 HerculesVR 于 2007-12-11 19:00 发表
, s3 l8 h; l& PFPGA现在的很多已经需要进行算法编写了，单纯PLD器件绝对是不能根FPGA抗衡啦···至少我问人FPGA已经不是单纯逻辑器件了，工功能和难度来说都上升了好多乜···3 w4 }6 G/ E0 U
1 r5 q8 o# M7 n( Z) i7 F
现在能把PLL.Performance.Simulation.and.Design ...
) [' r0 M7 ^$ Q) `8 t

& o- x* \/ R+ P是的，由于FPGA的规模现在上来了，现在在DSP领域，FPGA已经俨然成为新的硬件基础了。
作者: zifzhu    时间: 2007-12-11 19:40
FPGA和CPLD还是有很大的不同的。不只是规模上，而且是功能上的。比如PLL，on-chip-ram等等。! Z+ Z7 o6 v; t/ N; t" m
从DAC扯FPGA上了:w00t): / H, }5 G: w9 |- H2 T2 j) {7 P; [
  O0 K8 m2 F4 B0 d0 {
DSP的话，现在FPGA还不能和传统的DSP抗衡，便宜的性能上不够，而性能够用的又太贵。动则上千usd。最困难的还不是价格，而是开发难度。用FPGA来做DSP还不成熟。很难用。
) V/ Y( H- x" Y5 O5 e% y4 y  }' W, U2 d" ?( U+ L8 h- X8 y2 O
不管这么样，我还是认为用FPGA来分割I2S DAC的bit不是那么大众化的东西。至少我还没看见有这么做的，哪怕是高端DAC。
作者: HerculesVR    时间: 2007-12-11 19:47
标题: 回复 36# 的帖子
有时候有专利的人不一定非要把什么都要写EMAIL告诉你 呵呵··3 e: c, Q4 \) ?9 f. e! V% v
) b0 Y3 v3 l9 E3 b6 n! o# w0 `: T! ?, T
FPGA 是个高智商的交通管理员，DSP依旧是DSP··· 不过商业级市场上千USD的价格的FPGA我是没见过 ··呵呵··
* ?$ }& m( \6 i0 j7 k. ^4 k9 j. p/ x. [
上千的DSP也鲜有见···
作者: zifzhu    时间: 2007-12-11 20:03
原帖由 HerculesVR 于 2007-12-11 19:47 发表
0 ^1 ^% h3 S% U* u) U" b有时候有专利的人不一定非要把什么都要写EMAIL告诉你 呵呵··
- Z$ `, T# Q  p/ b% J0 U3 R! t) g; I7 |/ @% c. b
FPGA 是个高智商的交通管理员，DSP依旧是DSP··· 不过商业级市场上千USD的价格的FPGA我是没见过 ··呵呵··
+ D# {/ n, D+ I" z! @" ]9 a3 m1 M" i7 i! }- u
上千的DSP也鲜有见···
0 c! m$ e( {9 u( w
我有一个开发板上的ep2s60就要1k多usd了。要换成ep2s130的话得要5k多，ep2s180的话要10k多。都是usd啊。
. o5 p) k( o& [. c  w! ?" n4 `
' `+ a  G8 g: Y$ {上次去北京一个空军的研究所。那板子用了6颗ep2s180。吓得我都不敢摸板子了。可那里的工程师到处扔，烧了块板连眼都不眨一下。汗阿:sweatingbullets:
作者: HerculesVR    时间: 2007-12-11 20:16
标题: 回复 38# 的帖子
哥们 开发板跟芯片本身不一样····请不要混淆
4 C$ I% m" B# J: U. x5 y+ B$ a8 Z- \! a7 N7 h5 ~( o  Y
还有，我朋友专门给军队提供精密仪器的，只能到接待室还有人跟着，实验室可进不去··呵呵* V, I) \3 h# C$ H, z/ Y

# {5 @1 h0 `6 V6 X你很有能耐能进是实验室，不知道啥档次的·嘎嘎···
作者: zifzhu    时间: 2007-12-11 20:29
就是芯片这个价格http://search.digikey.com/scripts/DkSearch/dksus.dll?Cat=2556262;keywords=ep2s180
( J8 C& G# ]* P( V1 H这还是美国的价格，国内还得乘1.5。
, V3 F- a0 Q5 k/ T  }+ ~. t( l& D6 p" E  U  d1 y
我也是卖设备后给他们培训来着，感觉还可以。图纸啊什么都给我看，就是不能让我拷回去。他们还让我住他们里面的招待所来着。我想想还是是非之地不可久留啊，再说也不能上网，就没住那里面。9 [& z# k2 R, h* ^/ B' J$ ]0 G
感觉在军队里吃饭就是爽，不管是午饭还是晚饭都是他们包，而且标准极高。顿顿都是酒席。吃的我都不想回来了。
作者: HerculesVR    时间: 2007-12-11 20:39
digitech 属于比较垄断的行业 所以能有一些暴利，呵呵，不过这个毕竟不是FPGA  嘎嘎
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8 U( H$ Q. W8 x$ q军队里面都是国家包的··哈哈 好吃好喝··我没去过 不过听说都是不错。
5 z6 t6 s+ K2 \- `9 W2 i, P
5 U' O  u8 M1 b% R6 w不过我想底层军事单位不怎么样的··
作者: HerculesVR    时间: 2007-12-11 20:41
不过 一般FPGA 还是少有 那么贵的
作者: zifzhu    时间: 2007-12-11 21:04
原帖由 HerculesVR 于 2007-12-11 20:39 发表 , F, |) A) O. f+ g; A
digitech 属于比较垄断的行业 所以能有一些暴利，呵呵，不过这个毕竟不是FPGA  嘎嘎/ Z" E2 Q( M* @4 \" f
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军队里面都是国家包的··哈哈 好吃好喝··我没去过 不过听说都是不错。
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不过我想底层军事单位不怎么样的··
+ R1 z  E( D7 o7 ~

3 X6 x* Y: L- c$ z" |晕，digikey是经销商而已。9 b7 q5 N2 J0 b! r# v$ a" Z4 Y
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Altera和Xilinx是最大的FPGA厂商。5 @& _/ [* O# H! z" a3 g

  C) k& K4 Y& g) Gep2s开头的都是Altera的高端系列stratix ii的。就像奔腾和赛扬的区别。除了ep2s15和ep2s30，其它的stratix ii器件都要1k usd以上了。% y5 ^, e. `% F* I% A3 L

* ^0 X9 q5 n3 H7 T0 S: s+ o5 SAltera要出stratix iii了，打算到时候咬咬牙买一个stratix iii的开发板去。
作者: HerculesVR    时间: 2007-12-11 21:20
digikey  不是 digitech···
作者: zifzhu    时间: 2007-12-11 21:36
你说不是FPGA来着:wacko:
$ A! u- n9 m' U# g+ B) {4 Z1 `" w
8 k( @4 ^. Y4 Y1 h1 f1 R那digitech是什么？？？
作者: HerculesVR    时间: 2007-12-11 21:47
我以为是digidesign  就是做 pro tools的哪个··呵呵 不是digitech 效果器那个·· :loveliness:
作者: 酷风    时间: 2007-12-11 22:08
原帖由 Timme 于 2007-12-11 19:04 发表 ( o8 J  f9 \; p  f% B6 P. U
5楼的其实是串联不是并联...
; S0 ^1 L" M- f& @2 Y- j5 o7 y1 y$ n
怎么我看来看去都觉得是并联？:o
作者: gz0921    时间: 2007-12-11 22:43
原帖由 zifzhu 于 2007-12-11 19:40 发表 5 U1 S9 _2 J0 A% _! z% l
FPGA和CPLD还是有很大的不同的。不只是规模上，而且是功能上的。比如PLL，on-chip-ram等等。8 @, _- Z* B7 l! q
从DAC扯FPGA上了:w00t):
: R7 t- _$ q' W; }+ N5 h
6 n/ u( a! ~$ D: ADSP的话，现在FPGA还不能和传统的DSP抗衡，便宜的性能上不够，而性能够用的又太贵。动则上千 ...
7 Q2 D/ m! S# k5 V- T  `  G: ]
% F7 ?2 f$ T5 z' D9 n  A( ?
呵呵，看来你还是没怎么做过啊~
7 c9 U2 _. ]" Y% n( I" s6 C9 k我这里传统DSP已经不怎么用了，现在全用FPGA做了。
' q* j/ I0 L+ a* _) \. G/ q而且开发流程已经非常成熟了。从算法的高层次仿真，到转变成代码仿真，再到器件实现，很顺溜的一套流程。
0 o$ `% r- X# @5 ^$ ?9 ^" o# I. x而且，EP2S对消费类的东西来说太贵了，但是对工业产品来说，成本仍然可以接受，另外谁说用FPGA做DSP就非要EP2S不可，$ ?- H: T+ V+ R0 c3 Q* N
EP2C系列大容量的和EP3C系列都可以用的，而且我都在用~
' C# X- [) ?2 J, _# [
+ e: D+ H4 q8 S6 o1 `- C. L有些东西没做过就觉得很神秘，其实实践一趟下来就明白了，其实就那么点事~9 |& b: a4 J" o9 E2 \
1 e4 j/ x8 w* Q; I$ m6 A
回到声卡上来，就这个17bit数据MSB做选通信号，剩下16bit送给不同的DAC这个，就这么点功能，再算上DAC串行总线的接口部分的逻辑，用一个EPM570器件的话，可能50%都用不了~
作者: HerculesVR    时间: 2007-12-11 23:03
标题: 回复 48# 的帖子
不过有时候需要做数学计算很多使用DSP 协助一下好··呵呵
" O% s+ b# k" b; U/ J: S- g6 ~7 C* r% l; ^2 n, h% b0 e
比如 用FPGA 去写一个字长好长的 混响效果器，真够FPGA受的·
3 l- S$ L) `* M" k- T) W3 E! @
& Z" G/ C7 J% [1 ^不过blackfin是个不错的“杂种":loveliness:
作者: zifzhu    时间: 2007-12-11 23:56
原帖由 gz0921 于 2007-12-11 22:43 发表
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呵呵，看来你还是没怎么做过啊~
& g+ N0 p% ?6 Y0 \9 s, A3 q我这里传统DSP已经不怎么用了，现在全用FPGA做了。/ _9 B3 z% ^7 r( ]! J
而且开发流程已经非常成熟了。从算法的高层次仿真，到转变成代码仿真，再到器件实现，很顺溜的一套流程。5 a  \: Q" k, N* i1 k
而且，EP2S对消费 ...

  r6 _# E! f- q! z) n% M5 ]8 ?:ph34r:  / I0 a. p5 u  d2 x: p" S  ^9 x4 w

* A* T4 a  W+ U+ n3 \0 Y- S: VXD。)_)Stratix和Cyclone为什么价格差那么大。DSP性能是其中很主要的一个原因。说白了，DSP性能的强大就是stratix的主要卖点。Cyclone连个ALM也没有。要做DSP的话性价比还没有stratix高。' m5 x) I: y* f: g: j
再说就cyclone的dsp性能，随便找一个常规dsp来就可以了，还便宜的多。而stratix的dsp性能是现在常规dsp所不能达到的，只能用FPGA。否则谁想来惹这个麻烦事，还花那么多钱，不是没办法吗。我还是很少有听谁说用FPGA做DSP很方便的。我反正对FPGA来做DSP很头痛。连碰都不想碰。
作者: zifzhu    时间: 2007-12-12 00:42
原帖由 gz0921 于 2007-12-11 22:43 发表
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% _6 Z8 I; f* F+ l. X呵呵，看来你还是没怎么做过啊~
5 k# d5 d/ F, d) X$ L我这里传统DSP已经不怎么用了，现在全用FPGA做了。8 Q1 a* x# x/ l. }
而且开发流程已经非常成熟了。从算法的高层次仿真，到转变成代码仿真，再到器件实现，很顺溜的一套流程。
& B' d* x0 ^* b: Y( h2 T$ c而且，EP2S对消费 ...
  Q/ a9 r. A9 n: v

' l6 U+ X" _# f6 z' t再说，要截也不能截MSB啊。只能截LSB。
1 D2 R+ J6 `( _; G截了MSB要做什么？正负电源？差分？
- R1 }9 M' w4 {! x2 `/ G交越失真怎么办？Vbias怎么设？
3 F9 c9 w5 Q; P, \弄个0.1v的交越失真。出来的简直就不能叫声音了B)
作者: gz0921    时间: 2007-12-12 08:48
我说这个是因为我实际做过，没实际做过就不要妄下结论～
/ ^; f& p+ k1 e  s) A% S; N6 L) I. C失真做到0.1V，呵呵，那是人做出来的东西吗？



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