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标题: 公开了爱妻号nehalem的IDF详细介绍(居然是静态CMOS!!) [打印本页]

作者: gaiban 时间: 2008-8-21 23:22
标题: 公开了爱妻号nehalem的IDF详细介绍(居然是静态CMOS!!)
由印度小老头介绍:
采用低电压,静态CMOS工艺的爱妻号--对于超频人士无异于五雷轰顶的消息

[ 本帖最后由 gaiban 于 2008-8-21 23:27 编辑 ]

作者: gaiban 时间: 2008-8-21 23:27

作者: gaiban 时间: 2008-8-21 23:29

作者: gaiban 时间: 2008-8-21 23:32
图片来自IDF官网
http://www.intel.com/pressroom/k ... home+tab_audiovideo

Technology Insights
Next Generation Intel® Core™ Microarchitecture (Nehalem) Family of Processors: Screaming Performance, Efficient Power
Rajesh Kumar

作者: gaiban 时间: 2008-8-21 23:33
视频
http://www.viddler.com/explore/HardOCP/videos/2/

作者: china17 时间: 2008-8-21 23:43
turbo mode?把C2D移动版的技术搬进去了

作者: itany 时间: 2008-8-21 23:45
如果静态电路也能上5G+的话，岂不是更牛叉啊

另外求DPTS001、NGMS001、MGMC001的幻灯片，非常感谢！

[ 本帖最后由 itany 于 2008-8-21 23:51 编辑 ]

作者: seejiajia 时间: 2008-8-22 00:05
啥意思？看不懂啊，谁来解释一下？

作者: Prescott 时间: 2008-8-22 00:14
static CMOS{blush:]
没事，反正也是3.2GHz起跳{lol:]

作者: itany 时间: 2008-8-22 00:18

原帖由 seejiajia 于 2008-8-22 00:05 发表
啥意思？看不懂啊，谁来解释一下？

我也不懂，抛砖引玉
就是CMOS电路的基本逻辑有多种实现方法，最常见的就是静态电路和动态电路，前者耗电低，最高频率也低；后者最高频率更高，但是耗电更多。一般的处理器都是两个兼用的，在某些关键的地方采用动态电路，以保证可以实现较高的频率和性能。但是Nehalem说是完全采用了静态电路，这样楼主担心会影响最高频率。
多米诺是动态电路最常见形式

作者: itany 时间: 2008-8-22 00:21

原帖由 Prescott 于 2008-8-22 00:14 发表
static CMOS{blush:]
没事，反正也是3.2GHz起跳{lol:]

现在对Nehalem能上多少频率更加好奇了…… :lol:

Intel不会在里边用了什么貌合神离的火星技术吧？

作者: gaiban 时间: 2008-8-22 01:00

原帖由 itany 于 2008-8-21 23:45 发表
如果静态电路也能上5G+的话，岂不是更牛叉啊

另外求DPTS001、NGMS001、MGMC001的幻灯片，非常感谢！

去IDF官网寻了半天,就是没看到DPTS001、NGMS001、MGMC001的幻灯片啊. 可能很secret？

作者: gaiban 时间: 2008-8-22 01:07
45nm high-k工艺的静态CMOS有大突破?
如果高端爱妻号,是和扣肉一样使用domino, 给出一副很能超的样子.
而其实低端都用静态CMOS,五雷轰顶啊,就哭去吧.

作者: itany 时间: 2008-8-22 08:10

原帖由 gaiban 于 2008-8-22 01:07 发表
45nm high-k工艺的静态CMOS有大突破?
如果高端爱妻号,是和扣肉一样使用domino, 给出一副很能超的样子.
而其实低端都用静态CMOS,五雷轰顶啊,就哭去吧.

这是不可能的，如果这样的话，需要做大量的设计工作，很费事的……

作者: itany 时间: 2008-8-22 08:12

原帖由 gaiban 于 2008-8-22 01:00 发表

去IDF官网寻了半天,就是没看到DPTS001、NGMS001、MGMC001的幻灯片啊. 可能很secret？

看来只有等到IDF结束之后再看看了

作者: kw1943 时间: 2008-8-22 08:39
好多图.:crying:

作者: shike_cuke 时间: 2008-8-22 10:45
太复杂了，，，，，

作者: itany 时间: 2008-8-22 11:41
呼呼，除了static CMOS，还有L1、L2缓存都是8T SRAM
感觉真的是变天了……

作者: gaiban 时间: 2008-8-22 14:06
图片都没有了??

作者: gaiban 时间: 2008-8-22 14:08
还是看原版吧
http://intelstudios.edgesuite.net/fall_idf/tchs001/msm.htm

作者: gaiban 时间: 2008-8-22 14:10
Anand也有详细介绍了, 还用了些上次IDF后的一些图.
Nehalem - Everything You Need to Know about Intel's New Architecture
Anand Lal Shimpi
http://www.anandtech.com/cpuchipsets/intel/showdoc.aspx?i=3382

作者: gaiban 时间: 2008-8-22 14:13

原帖由 itany 于 2008-8-22 11:41 发表
呼呼，除了static CMOS，还有L1、L2缓存都是8T SRAM
感觉真的是变天了……

眼好尖, 8M L2就要8*8*8=5.12亿个晶体管？！

作者: itany 时间: 2008-8-22 14:30

原帖由 gaiban 于 2008-8-22 14:13 发表

眼好尖, 8M L2就要8*8*8=5.12亿个晶体管？！

8M L3仍然是6T的，只有核心的缓存才是8T的
要是用8T SRAM做8M L3缓存，岂不是要赔死

作者: itany 时间: 2008-8-22 14:35

原帖由 gaiban 于 2008-8-22 14:10 发表
Anand也有详细介绍了, 还用了些上次IDF后的一些图.
Nehalem - Everything You Need to Know about Intel's New Architecture
Anand Lal Shimpi
http://www.anandtech.com/cpuchipsets/intel/showdoc.aspx?i=3382

说实话，这个介绍乏善可陈，绝大部分的内容都是已经听说了的
不过正像Anand站长说的，现在万事俱备，只欠Intel全面给媒体派发样品测试了

作者: hunter3618 时间: 2008-8-22 16:07
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作者: itany 时间: 2008-8-23 10:29
哎，还是顶一下吧，好不容易有个技术贴，别沉了

作者: NONO 时间: 2008-8-23 12:09
何時正式公佈Nehalem的体系架構??

作者: itany 时间: 2008-8-23 13:05

原帖由 NONO 于 2008-8-23 12:09 发表
何時正式公佈Nehalem的体系架構??

这个不是已经公布了么？

作者: NONO 时间: 2008-8-23 13:41

原帖由 itany 于 2008-8-23 13:05 发表

这个不是已经公布了么？

應該說是架構詳解，就像之前Core2出來的時候那樣，各大硬件都有報導

作者: itany 时间: 2008-8-23 13:56

原帖由 NONO 于 2008-8-23 13:41 发表

應該說是架構詳解，就像之前Core2出來的時候那樣，各大硬件都有報導

实际上，现在已经有了好几个文章了啊
比如：http://www.realworldtech.com/page.cfm?ArticleID=RWT040208182719
还有：http://www.anandtech.com/cpuchipsets/intel/showdoc.aspx?i=3382

只不过现在国内小网站可能还没有翻译好吧

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