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原帖由 Edison 于 2006-7-27 21:39 发表 体系架构问题,GPU的任务适合于并行处理,所以着力点在增加流水线数量和其他并行单元上,GPU里唯一不能拆开的可能就只有setup。 在以往,如此多的并行单元如果弄到XGHz,内存总线根本不负重荷,所以也就没必要 ...
原帖由 gz0921 于 2006-7-27 21:49 发表 这还不简单,晶体管多呗~~
原帖由 博士僧 于 2006-7-27 21:37 发表 有没有学EE的给解释一下,谢谢.
原帖由 博士僧 于 2006-7-27 21:54 发表 高端的是比CPU多,主流和底端并不比CPU晶体管多.
原帖由 gz0921 于 2006-7-27 21:59 发表 是吗?貌似高端的晶体管数量是CPU的6-10倍,主流的摸去一半也比CPU多不少吧~ 当然,芯片运行在多高频率不光跟晶体管数量有关,但是在GPU里,这应该是个主要的因素吧
原帖由 博士僧 于 2006-7-27 22:03 发表 不是,目前INTEL的家用CPU晶体管数量大概3.76亿个,其实跟最高级的GPU晶体管数量相当,至于安腾,晶体管17亿个,更是远远超过高端GPU. 即便用近似工艺近似晶体管数的GPU/CPU比(比如NV34M跟P4的早期版本比), 前者 ...
原帖由 gz0921 于 2006-7-27 22:05 发表 3760万吧?难道我记错了...:sweatingbullets:
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