K10的Erratum 298，果然是缓存同步问题

colddawn · 发表于 2007-12-11 18:41

对错误298的描述如下："处理器操作可能不是原子性的，在二级缓存中改变页面转换表项目中从0b到1b地址的被访问过的或脏字节。在一个细小的时间间隔内，在修改过的复制数据返回二级缓存之前，其他缓存操作可能引起失效的页面转换表项目被安装在三级缓存中。另外，如果在该时间间隔期间检测到该缓存行，处理器不会对该被访问过的或脏字节，以及可能发生错误的数据进行无关的缓存操作。系统可能会通过一次机器检测事件，报告发生了一次三级缓存协议错误。在这种情况下，MC4状态寄存器(MSR 0000_0410)的内容将会是B2000000_000B0C0F或BA000000_000B0C0F。MC4地址寄存器(MSR 0000_0412)的内容将会是26h。"

　Wahlig对Linux补丁程序的工作过程作了描述，该补丁程序也绕过了BIOS工作区并仿真"被访问过的和脏字节"，以阻止错误数据建立文件头：

　内核补丁解决方案取决于二级缓存迁出问题的根本原因。只有当TLB需要在一个页表项目中设置一个A或D位时，问题才暴露。如果TLB永远不需要设置一个A 或D位，错误则不会出现。通过使用当前的可写位对A和D位进行仿真，补丁程序将确保经常对实际的A和D位进行预设。当首次访问一个未对仿真A位进行设置的页面时，并且当首次写访问一个未对仿真D位进行设置的可写页面时，通过对一个错误页面进行强制而完成该处理。仿真A和D位存储在位寄存器中，操作系统通常可以在页表项目中取得它。

　AMD以比最初预期更为委婉的说法，停止发行该补丁程序，但公司并没有给所有Linux用户发放"通行证"，用来避免BIOS修复程序带来的性能损失。

话说K10最引人注目的也就是这多层次的cache了吧，好不容易能有点技术上的突破，结果还是经验不足没打响这一炮，让一个bug给闷回去了。这即不像IMC时能恰好解决当时内存带宽不足的软肋，又不像64位时光靠市场推广就能说动消费者。恰恰犹如当年Pentium的浮点bug的情形时那样大家都知道你有问题，虽理论上不致命但就算小白也认定你的U不可靠，这下难受了吧。技术积累底蕴不足，危机公关能力不强，这一关真可谓难过了。当年只要态度好，只要回收，就当交点学费都能挺过去，但现在内忧外患，墙倒众人推，就看AMD怎么挺吧。

鲁爾 · 发表于 2007-12-11 19:11

:unsure: :unsure:

只看该作者 · 发表于 2007-12-11 19:15

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colddawn · 发表于 2007-12-11 19:26

原帖由 potomac 于 2007-12-11 19:15 发表
intel那个BUG，只是发生在Excel中的某个特定值的计算上。
这次AMD是L3出问题了。对整个性能都有影响。

不是，是存在缓存同步时的考虑不当可能使某些指令返回错误的结果，为了保证正确才打补丁，从而导致性能问题。

sonicxz · 发表于 2007-12-11 19:40

(_( 早点加大L1,L2不就好了，搞什么L3，玩火自焚了吧

zicfy · 发表于 2007-12-11 19:55

唔.....讨论这么深入啊......
L3是挺创新的.

只看该作者 · 发表于 2007-12-11 20:20

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只看该作者 · 发表于 2007-12-11 20:21

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多铆蒸钢 · 发表于 2007-12-12 17:27

k6-3~~~飘过

itany · 发表于 2007-12-12 17:42

原帖由 potomac 于 2007-12-11 20:21 发表

K6时代，AMD就已经创新过了。:loveliness:

应该说是共享缓存对于AMD是创新……

(_(

shike_cuke · 发表于 2007-12-13 14:01

AMD还是没把多级缓存给玩转啊!

夜专 · 发表于 2007-12-13 16:00

三年前P4至尊版也搞过L3啊，搞L3的目的就是L2命中不了目标再到L3上面找，这本来就是服务器的U才有的设计。

colddawn · 发表于 2007-12-13 16:21

原帖由夜专于 2007-12-13 16:00 发表
三年前P4至尊版也搞过L3啊，搞L3的目的就是L2命中不了目标再到L3上面找，这本来就是服务器的U才有的设计。

搞L3不是创新，当年主板上还存在过L3呢。
搞多核cpu共享L3才是问题所在，这里面的同步问题不是那么好解决的，考虑到效率就更难办一点，所以AMD载在这里了，不过话说回来这似乎也不是创新，但是对于AMD，对于X86的桌面应用领域，算是比较跨越式的创举了，可惜AMD这一步没跨好踩粪坑里了。

ITANIUM2 · 发表于 2007-12-13 16:48

没事没事, AMD吃一堑长一智, 但愿还能有下次:thumbsup:

qiancong1980 · 发表于 2007-12-13 23:37

K10有L3 K6-3就有L3了不算创新了吧:lol:

只看该作者 · 发表于 2007-12-14 00:21

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jackli77 · 发表于 2007-12-14 00:30

:w00t): :w00t): :w00t):

itany · 发表于 2007-12-14 01:03

原帖由 AlcatrazX 于 2007-12-14 00:21 发表

我是菜鸟，有一点不懂，多核共享L3与多核共享L2在技术实现上有很大的不同么？请指教，为什么共享Ｌ３是如此大的创举呢？

本来共享缓存需要解决不同核心访问的仲裁和同步问题，这样将增加缓存访问的延迟。关键性的问题就是如何把延迟控制在可以接受的范围
L2对于延迟更敏感，所以共享L2的难度要大于共享L3。比如现在Intel也就是两核心共享L2，再多核心可能就搞不定了，也要独立L2、共享L3
至于共享L3，从Phenom的L3性能，尤其是延迟来看，基本属于嘴有多大创举就有多大……

kunnsr · 发表于 2007-12-14 11:11

原帖由 zicfy 于 2007-12-11 19:55 发表
唔.....讨论这么深入啊......
L3是挺创新的.

K6 3的时候就用过了回锅肉没炒好而已

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potomac 该用户已被删除	3^# 发表于 2007-12-11 19:15 \| 只看该作者提示: 作者被禁止或删除内容自动屏蔽
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