NVIDIA 静悄悄地公布了 echelon 体系架构以及芯片面积曝光，290mm^2

vipk · 发表于 2012-1-6 14:45

asdfjkl 发表于 2012-1-6 11:05
面积：290mm;工艺是10nm,折算到28nm将近950mm了，堪称巨大！！！

应该是2274mm 算数都不会

disruptor · 发表于 2012-1-6 16:03

这分不清cpu和gpu部分了吧，那个noc应该就是完成cpu功能的部分吧，不过和sm已经拆不开了。dram部分究竟用什么应该都还没有

Edison · 发表于 2012-1-6 16:08

noc = network on chip。

disruptor · 发表于 2012-1-6 16:14

哈哈，原来就是router。难道cpu是绿色的那一小部分吗

badchris · 发表于 2012-1-6 16:22

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Edison · 发表于 2012-1-6 16:23

CPU 在上面的架构图比较难看到，它在这儿：

gzpony · 发表于 2012-1-6 16:24

disruptor 发表于 2012-1-6 16:14
哈哈，原来就是router。难道cpu是绿色的那一小部分吗

整个就是cpu啊。融合了

disruptor · 发表于 2012-1-6 16:24

绿色的是xbar，黄的是通讯，cpu压根儿就没写出来

66666 · 发表于 2012-1-6 16:24

从构架图看OOO只限于CPU部分吗？

badchris · 发表于 2012-1-6 16:26

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Edison · 发表于 2012-1-6 16:41

SC10 时候系统架构的样子：

Edison · 发表于 2012-1-6 16:42

badchris 发表于 2012-1-6 16:26
怎么降到16TFLOPS了……SM Lane加倍了双精度还跌了20%，难道不用Maxwell了？

也许新的没有算上 CPU？

eDRAM · 发表于 2012-1-6 21:25

40T的双精度应该可以流畅的跑光线追踪了吧？

Edison · 发表于 2012-1-6 21:29

eDRAM 发表于 2012-1-6 21:25
40T的双精度应该可以流畅的跑光线追踪了吧？

no way。

eDRAM · 发表于 2012-1-6 22:19

Edison 发表于 2012-1-6 21:29
no way。

那要多少才够呢？

fengpc · 发表于 2012-1-6 23:30

mooncocoon 发表于 2012-1-6 11:43
一上来就奔着目前最大的物理极限而去了是么

HPC不像游戏卡那样在乎功耗和噪音～～而且500mm2左右才是极限吧，最近几代的旗舰卡都是

mooncocoon · 发表于 2012-1-7 10:56

fengpc 发表于 2012-1-6 23:30
HPC不像游戏卡那样在乎功耗和噪音～～而且500mm2左右才是极限吧，最近几代的旗舰卡都是

我说的是制程，不是大小……大小这事情上极限就像节操一样，早就被丢掉了，详情请参见动辄脸盆大的功率半导体

yeemartin! · 发表于 2012-1-7 11:01

为啥有个斯坦福大学的标志?

Edison · 发表于 2012-1-7 14:59

darkstorm 发表于 2012-1-7 14:05
不是延迟优先么

延迟先决一个意思

ptmd · 发表于 2012-1-7 17:33

本帖最后由 ptmd 于 2012-1-7 17:38 编辑

4 DFMAs per lane 缩了水作 2 DFMAs per lane，SM 现在只有 16 DFMAs 了。
不过Echelon 还是在很早期的纸面设计阶段吧... 距离18 年还有六年的大好时光，Nvidia 把东西就都摊出来了...

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badchris badchris 当前离线积分 7 IP卡狗仔卡头像被屏蔽	25^# 发表于 2012-1-6 16:22 \| 只看该作者提示: 作者被禁止或删除内容自动屏蔽
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