PCI-E总线的延迟有没有测试？

mperson · 发表于 2010-1-20 18:39

几种架构的芯片组                PCI-E 2.0的速度
X48                                           16+16
X58                                           16+16
X58+nforce200                         16+16
P55+Lynnfield                               8+8
P55+Lynnfield+nforce200          16+16

这几种组合有具体的PCI-E传输测试吗？传输不同量的数据时的实测结果
我想知道比如X48的FSB结构会不会导致cuda编程的时候设备内存到主内存的传输比QPI结构慢，P55的X8+X8会不会导致传输慢？

根据一点点SLI的游戏测试推测似乎是X58(X16+X16)约等于P55(X8+X8)>X58+nforce200(X16+X16).

Edison · 发表于 2010-1-20 18:47

http://www.hypertransport.org/docs/wp/Low_Latency_Final.pdf

mperson · 发表于 2010-1-20 18:52

谢谢E大····不过这个有点老，我研究研究

Edison · 发表于 2010-1-20 19:33

http://www.dolphinics.com/soluti ... _hpc_solutions.html

Mia · 发表于 2010-1-23 12:35

LZ 玩儿的够细的呵呵

kglceo · 发表于 2010-2-4 18:28

还有这说法啊？厉害

a190158178 · 发表于 2010-2-11 08:32

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zhen179 · 发表于 2010-2-11 12:33

有精力有能力把这些技术环节是搞得越清楚越好，呵呵，一般玩确实不会去品味这些细节，看不见摸不着的东东~~~ 楼主要求的最好还是比较透明的数据，这能够帮助理解~~~ 不错，这比这种只知道顶啊顶的帖子技术含量要高多了~~~

linxiabing · 发表于 2010-2-16 00:10

LZ 玩儿的够细的呵呵

中华千年老妖 · 发表于 2010-2-23 13:43

现在的主板BIOS里都有一个PCI-E的Y延时设置，最低好像可以设置到32，最高256，以前网上有份文章好像说过PCI-E设备多的主板最好设置为64，这样可以确保稳定，PCI-E超频则最好设置到256。PCI-E的数据包比较大，大的延时对一般桌面应用影响并不明显，倒是对并发大批量小数据的服务器应用影响比较大。

ic.expert · 发表于 2010-2-23 15:00

这种总线延迟的cycle数会一代比一代大，这就是设计趋势：〉

lct2050 · 发表于 2010-2-25 09:28

玩太细致了吧

top1026 · 发表于 2010-3-11 18:41

不知道是什么情况

fjfzlx · 发表于 2010-3-19 12:28

最好把X38加上。

xeon-pan · 发表于 2010-3-20 16:56

因为图形渲染这个对于延迟不敏感吧。和显存一样，大带宽就是一切

xyking · 发表于 2010-4-13 04:55

我觉得PCI-E2.0的带宽也快不够了，尤其是多条PCI-E数据并流的时候

bull · 发表于 2010-4-15 13:51

求一个测试显卡到CPU之间大流量数据传输延迟的测试软件。。。。

lslwwwq · 发表于 2010-4-16 23:10

应该不会

liuyanantj · 发表于 2010-4-17 13:51

X8 的应该会有影响的

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