big.LITTLE，三星那个4A15+4A7，貌似真能8核全开

YsMilan · 发表于 2012-12-28 09:43

Tempestglen 发表于 2012-12-28 09:36
你以为arm工程师连这种cpu间如何交换数据的基本原理都不懂？

arm内部的层层技术审核形同摆设？让你们口 ...

说T神不懂眨眼间就变成ARM工程师不懂了...

有审查就说明是好东西？那么这世上还有失败产品吗？
搞过工程的不知道什么叫妥协？这个big.little不叫妥协不知道什么才叫

raini · 发表于 2012-12-28 09:59

本帖最后由 raini 于 2012-12-28 10:00 编辑

Tempestglen 发表于 2012-12-28 09:36
你以为arm工程师连这种cpu间如何交换数据的基本原理都不懂？

arm内部的层层技术审核形同摆设？让你们 ...

搞项目管理的人就一定懂技术细节了？
高层需要对外吹水，根本不需要知道水有多大！
你麻痹的有审查就了不起了？
google也死掉了很多项目，难道这些项目都没有审查吗？
不要说软件业，就算硬件业，
ibm画的cell大饼把sony坑进去了，
amd吹水反向超线程，
arm界的t3也是1小核+4大核，
哪个没审查过？哪个公司高层觉得不对了？
结果呢？结果都是屎一样！

frankincense · 发表于 2012-12-28 10:02

Tempestglen 发表于 2012-12-28 09:36
你以为arm工程师连这种cpu间如何交换数据的基本原理都不懂？

arm内部的层层技术审核形同摆设？让你们 ...

ARM的工程师当然比你懂多了，他们也肯定知道这种内核切换需要牺牲的东西。
但是技术没有达到什么都能解决的程度时，只能牺牲部分来满足另一部分的目标。
BigLittle就是牺牲切换过程的性能损失，来减轻A15在轻载时也无法压下来的巨大功耗。至于这样值不值得，至少ARM认为在A15涉及的领域，这种牺牲比A15高功耗带来的续航能力损耗要值得。

raini · 发表于 2012-12-28 10:03

本帖最后由 raini 于 2012-12-28 10:04 编辑

Tempestglen 发表于 2012-12-28 09:36
你以为arm工程师连这种cpu间如何交换数据的基本原理都不懂？

arm内部的层层技术审核形同摆设？让你们 ...

“一个项目要从可行性研究报告开始一步一步经过基础设计、详细设计一步步经过专家审查”
你也知道工程项目要这样做呀！那你给的那些才到可行性研究呀，连这个都要招到外界的质疑呢！你倒现在开始吹水来了！脑内high到不行！还切换是非常快的，可以忽略不计

Tempestglen · 发表于 2012-12-28 10:17

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Tempestglen · 发表于 2012-12-28 10:20

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YsMilan · 发表于 2012-12-28 10:21

Tempestglen 发表于 2012-12-28 10:17
通过可行性审查的工程就算靠谱的，之后有50%还是80%的工程失败了，那是另一个问题。

三星exynos5450的 ...

跟你说CPU数据交换你来扯实际运行效果
T神的转进能力果然过人...

darkangel308 · 发表于 2012-12-28 11:13

Tempestglen 发表于 2012-12-28 10:17
通过可行性审查的工程就算靠谱的，之后有50%还是80%的工程失败了，那是另一个问题。

三星exynos5450的 ...

exynos5450有性能和功耗数据了？哪有？

Tempestglen · 发表于 2012-12-28 11:23

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etermis · 发表于 2012-12-28 11:35

我有点好奇，2ms这个时间是哪里提出来的？

下面的网址里是ARM去年提出的b.L文档，里面提到的设计切换时间似乎是20us，而看三棒子的PPT截图似乎实作是30-50us

http://www.arm.com/zh/files/downloads/big_LITTLE_Final_Final.pdf

当然设计目标能否达到是另一个问题，但是这种思路也不一定就毫无价值。

raini · 发表于 2012-12-28 11:36

本帖最后由 raini 于 2012-12-28 11:36 编辑

Tempestglen 发表于 2012-12-28 11:23
实际运行效果是检验理论的标准。

你们提出来的技术质疑，最终是以影响实际性能为理由，可惜实际运行效 ...

“你们提出来的技术质疑，最终是以影响实际性能为理由，可惜实际运行效果不错，反证了技术困难已经基本被克服。”
呵呵，实际运行效果在哪里？不会在你脑内吧！

“你们这些iT中人不明白如何克服技术困难的话，可以写信给arm寻求帮助，用不着在这里酸。”
所以你已经写信给arm了，arm也告诉你技术秘密了，然后你就在这里大幅吹水，大放厥词了？
在这里酸的是arm吗？酸的是你的毫无理由的脑内YY！跟arm有个毛关系！
连最基本的意思都搞不明白，果然是小学语文不及格，外加智商没有的脑残！

PRAM · 发表于 2012-12-28 11:48

T神连三星AP的型号都说错了

Tempestglen · 发表于 2012-12-28 12:00

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Tempestglen · 发表于 2012-12-28 12:02

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raini · 发表于 2012-12-28 12:20

Tempestglen 发表于 2012-12-28 12:00
lz已经贴出来了吧。

在跑Quadrant，Antutu，Coremark，web browser bench的时候，四核A15＋四核A7的bi ...

“看看哪个 OS的百分之几的软件会支持八线程”
又来秀下限了

这个根本不是实际的功耗，都是一些推算！有种把功耗数据放出来，以及把实物的真实续航能力放出来！这都能让SB神high起来，SB神，你的要求还能再低吗？

Prescott · 发表于 2012-12-28 12:22

etermis 发表于 2012-12-28 11:35
我有点好奇，2ms这个时间是哪里提出来的？

下面的网址里是ARM去年提出的b.L文档，里面提到的设计切换时间 ...

20us是保存/迁移/恢复寄存器状态的时间。不包括迁移的目标核心从深度睡眠中恢复的时间。

另外缓存的完全失效也是一个问题。迁移的目标核心完全没有任何缓存的数据，包括ITBL/DTLB，整个缓存warm up的时间绝对不可忽略。每次缓存Miss的开销至少100个周期，切换造成几千次Miss非常正常，这就已经将近一个ms的开销了。TLB miss次数少很多，但是每次开销更大。另外，分支预测的上下文也没了。这些都是开销。

Tempestglen · 发表于 2012-12-28 12:23

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acqwer · 发表于 2012-12-28 12:29

棒子官方数据45nm到32nm HKMG功耗降低30%，T神嘴巴一张同代工艺就直接降了50%。

acqwer · 发表于 2012-12-28 12:40

本帖最后由 acqwer 于 2012-12-28 12:40 编辑

Tempestglen 发表于 2012-12-28 12:23
在跑Quadrant，Antutu，Coremark，web browser bench的时候，biglittle芯片的功耗就是四核纯A15的功耗，比较 ...

Z2760 压力测试的时候CPU功耗1.39W，四核也就2.8W，功耗只有你家1.7G A15的一半不到，性耗比高了一倍。

Tempestglen · 发表于 2012-12-28 12:48

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