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关于多DAC并联的一些问题,请高手解答

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1#
发表于 2007-12-10 14:36 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
在多DAC并联之后,会带来哪些好处?
. ~; V& q) i  Z4 H% e6 K我记得有人说过并联之后会降低jitter值,除此以外还有其他的影响吗?
$ T8 i6 ?7 y+ A' U( r输出的信号强度会不会有变化?' v" V5 G/ e) p- W, G9 Q8 V
我指的是vrms的值,电压在并联之后会不会有所提升
2#
发表于 2007-12-10 14:46 | 只看该作者
好处啊,线路比较烂的DAC可以得到更高的信噪比啊、动态范围啊之类:p
& f4 P" D2 ]( C) K前提是线路比较烂哦~
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3#
发表于 2007-12-10 14:46 | 只看该作者
不懂,来看答案:a)
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4#
发表于 2007-12-10 15:48 | 只看该作者
应该是THD吧。jitter是时序的问题,应该和DAC芯片无关。Vrms也不会有变,并联吗,一个2.6v和一个2.4v并一起不能得到5v的。同样,也不会是2.5。因为不管什么输出级,拉低和拉高的电流是不一样的,而且一般都还相差蛮大的,不过总归会靠近2.5一些,所以多少还是有些效果的。并联就像现在的SLI一样,实在是用了最好的芯片还不够才这样做,7600gt再怎么SLI也比不过8800ultra的。建议还是用一个好一点的芯片就行了。
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5#
发表于 2007-12-10 16:23 | 只看该作者
浅谈音频DAC的特殊用法
二、并联法( ]: }5 S" Q% l% s2 C4 S5 p+ U
并联使用DAC可提高等效比特数,提高转换精度,还原音乐的厚度感和力度感增强,在DAC的其他用法中,也可再施加此法,效果显著,因此它在高档机中获得了广泛的应用。
* ~! n/ A+ h& F. l$ }3 B& y' B. h8 C
- |7 O8 d8 ^" h3 T; W' J4 F# j8 o; n1 ^6 A
原理见图2a)所示。nDAC并联同步工作,将nDAC输出的电流信号相加,再经过电流/电压(I/V)变换,输出模拟电压信号。& v- t8 J% K( G6 `9 g
这种方法对小信号处理能力明显增强,等于增加了DAC的比特数。例如,218 bit DAC并联后的转换精度相当于19 bit420 bit DAC并联后转换精度相当于23 bit ,而820 bit DAC并联后转换精度相当于24 bit,等等。PCM170424 bit DAC出现之前,高档数字音响的24 bit转换精度就是利用多个DAC并联方法得到的。
2 [# q( O( b& }8 a6 w$ h1 LDAC并联使用时,信噪比、动态范围都会提高,而失真度将会减小,各种误差也被平均化而降低。  B+ F. i7 q. r
例如,对4个性能一致的20 bit DAC芯片进行并联实验,分别对1个、2个并联、3个并联、4个并联的信噪比(SNR)、总谐波失真(THD)、动态范围(DR)进行测试,测试的结果分别见图2b)、图2c)和图2d)所示。
: J: _$ h5 y1 Y# j# R, @5 q- x7 X从图2b)的信噪比(SNR)特性测试图可以看出,随着DAC并联数目的增加,信噪比明显增加,由单个的115.8dB增加到2个并联的117dB3个并联的119.2dB4个并联的120.7dB
2 \" ?/ e, ^! G从图2c)的总谐波失真(THD)特性测试图可以看出,随着DAC并联数目的增加,总谐波失真也有降低,由单个的0.0024%降低到2个并联的0.0019%3个并联的0.0016%4个并联的0.0014%2 {: b  d2 s+ D7 ~; [: N
从图2d)的动态范围(DR)特性测试图可以看出,随着DAC并联数目的增加,动态范围也在提高,由单个的100.5dB增加到2个并联的101dB3个并联的101.3dB4个并联的101.5dB8 C4 v0 }/ u/ T- }

, H; f7 i3 Q% \- {  e3 j3 W6 ^  ~3 B$ ]( h0 q# L. u
9 W5 _4 i& Z, X( u" g
详细内容可以去这里看看:
* m( ]8 C# N% _' }& mhttp://www.audio-gd.com/audio/two/new_page_18.htm
/ V; t  s) w0 Y) u' q, k  F6 `+ o9 Phttp://www.go-gddq.com/html/2006-10/407373.htm/ T% ~8 s, ~) R/ |

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6#
发表于 2007-12-10 16:34 | 只看该作者
原帖由 chairmanai 于 2007-12-10 16:23 发表
4 [; K% Z+ _0 F0 D7 U* @浅谈音频DAC的特殊用法二、并联法
/ B- E/ Z  p6 ]" p- C并联使用DAC可提高等效比特数,提高转换精度,还原音乐的厚度感和力度感增强,在DAC的其他用法中,也可再施加此法,效果显著,因此它在高档机中获得了广泛的应用。
- ^' H) e) i4 H: L8 f0 s- N; j2 H& y3 I" ]6 O
812271: h- x' Z  C& H# p4 N# k6 n
原理 ...
8 a/ y$ @( h2 E& u( Z# b1 W$ b
audio-gd:rolleyes: $ }, Z. p( q& Z- ~
我就是请教了这个老板后才去尝试并联DAC的-_- 他比较空闲的时候还是很有耐性的:shifty:
4 ?* q: q7 B3 d
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7#
发表于 2007-12-10 16:37 | 只看该作者
原帖由 一生相随 于 2007-12-10 04:34 PM 发表 ( K* A5 @( E+ Q4 W  G

3 f8 N& T6 g4 h  S0 G3 S( L: Saudio-gd:rolleyes: 5 @, V; z3 A$ p; g
我就是请教了这个老板后才去尝试并联DAC的-_- 他比较空闲的时候还是很有耐性的:shifty:
  R. j1 N7 e7 p1 i$ ]

! D# C$ x2 {# E他在土炮界也算小有名气了:lol:
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8#
发表于 2007-12-10 16:38 | 只看该作者
原帖由 chairmanai 于 2007-12-10 16:23 发表 - A# t& a$ F. B- x( E0 B! _, e
浅谈音频DAC的特殊用法二、并联法6 o. `( I; f" s0 K, {* ~( ]4 w! F
并联使用DAC可提高等效比特数,提高转换精度,还原音乐的厚度感和力度感增强,在DAC的其他用法中,也可再施加此法,效果显著,因此它在高档机中获得了广泛的应用。, m- ]0 y. Q) b$ @7 `7 K

' u! G- _$ K6 x/ `# E812271
$ ^  Z; d3 ~* x  S% S1 r: K  Q: ^原理 ...

! W. \; J1 \5 `, {就是搞不懂为什么会提高bit数。信号源就就是那么多bit,DAC哪里去自己加几个bit呢?除非信号源是高bit的,比如20bit。DAC是低bit的,比如18bit。那么信号源就可以分配四个不同的数据到四个DAC后并联取平均值。比如, x0 e: x, R! l6 M
20bit:    000000000000000001 可以这么分配
6 P/ O, I8 x' v& b+ H18bit_0: 0000000000000001
  Y& A- e0 B$ l& l5 _18bit_1: 0000000000000000- K2 t, E0 t& C) _8 `& X% L' j1 u
18bit_2: 0000000000000000
- Y/ I, o& t1 Z7 J9 Y( H2 l. _18bit_3: 0000000000000000
  O) }' |; a. j9 a; }这样就是20bit了,因为输入是不同的,所以输入不能并联起来,要做这个动作还是蛮复杂的,除非自己写FPGA来做,现成的IC一般都不会有这种功能。
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9#
发表于 2007-12-10 16:48 | 只看该作者
弄的越来越复杂了:sweatingbullets: 还是我的一托锡简单,就这样并了,引用别人的话:shifty: 谁用谁知道-_-
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10#
发表于 2007-12-10 16:51 | 只看该作者
其实提高bit数那一段我也看得不是一般纳闷:sweatingbullets:
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11#
发表于 2007-12-10 17:07 | 只看该作者
原帖由 chairmanai 于 2007-12-10 16:23 发表
. v; o3 ^( T3 \* v$ J/ }! ~浅谈音频DAC的特殊用法二、并联法4 p) i, G1 M) {1 T- J/ ^
……
5 `2 v( h. r3 o3 ^- g" a4 R$ ]……% P  K7 b1 B2 Q: d$ @
例如,2个18 bit DAC并联后的转换精度相当于19 bit,4个20 bit DAC并联后转换精度相当于23 bit ,而8个20 bit DAC并联后转换精度相当于24 bit,等等……
7 |! l# z5 e3 F4 T3 q
鸡蛋里挑点骨头:loveliness:   貌似应该是“4个20 bit DAC并联后转换精度相当于22 bit ,而8个20 bit DAC并联后转换精度相当于23 bit”
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12#
 楼主| 发表于 2007-12-10 18:03 | 只看该作者
看来并联的好处多多呀!:w00t):
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caojy 该用户已被删除
13#
发表于 2007-12-10 23:11 | 只看该作者
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14#
 楼主| 发表于 2007-12-11 10:55 | 只看该作者
原帖由 caojy 于 2007-12-10 23:11 发表
( _4 @( Z9 d1 J+ g9 H3 B5楼的回答是抄电子报的,还把它的错误一样抄来。

% T$ d+ m- k* V什么错误?能不能说一下?
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15#
发表于 2007-12-11 12:23 | 只看该作者
原帖由 酷风 于 2007-12-11 10:55 发表
+ ?$ B" s! @5 ?% i7 X, @9 e& T6 ^1 ~" [6 O( [$ V
什么错误?能不能说一下?
! H8 D) t0 `8 u8 s
貌似就是我11楼说的那个吧?:unsure:
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16#
发表于 2007-12-11 12:28 | 只看该作者
DAC 电路并联,没有一个好时钟 那基本就是劣化音质···
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17#
发表于 2007-12-11 12:40 | 只看该作者
提高比特数其实道理很简单,可以拿两个并联的情况来说明。, z. W  X' Z9 \& |
1 V5 e* _' i' d: V
比如输入信号是17bit的,去掉符号位,为16bit,那么使用两个16bitDAC,用输入数据的符号位做数据选通信号,整数时送给一个DAC,负数时送给另外一个DAC,二DAC输出的参考分别接正负基准源,再用差分运放将两DAC的输出合成,那么就相当于用两个16bitDAC达到一个17bitDAC的精度了。
' B/ v5 ^6 R" `+ i& z* T! I+ _6 K8 \
依次类推,合并两组这种结构,就有18bit精度~
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18#
发表于 2007-12-11 13:10 | 只看该作者
原帖由 gz0921 于 2007-12-11 12:40 发表
) B& Q& y0 n: N( W/ O3 r' {提高比特数其实道理很简单,可以拿两个并联的情况来说明。. Q- i/ X1 u  T8 w3 z, d/ e1 N
9 J. G" A& W* x5 E6 H
比如输入信号是17bit的,去掉符号位,为16bit,那么使用两个16bitDAC,用输入数据的符号位做数据选通信号,整数时送给一个DAC,负数时送给另外一个DAC, ...
- C( L9 z9 t, Q& e# x- h* H# w
很大一部分的DAC都是串行总线的。所以去分割bit位不是加几个门电路就能解决的,要自己写FPGA。所以个人对提高比特数这个说法还是持保留态度。
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19#
 楼主| 发表于 2007-12-11 13:43 | 只看该作者
原帖由 HerculesVR 于 2007-12-11 12:28 发表
! e  G2 B( v; n$ e; xDAC 电路并联,没有一个好时钟 那基本就是劣化音质···

/ Q7 D5 u2 i8 ?; l看来下一步就是要换个精度更高的晶振了……
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terryddb 该用户已被删除
20#
发表于 2007-12-11 14:25 | 只看该作者
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