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关于多DAC并联的一些问题,请高手解答

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1#
发表于 2007-12-10 14:36 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
在多DAC并联之后,会带来哪些好处?' `7 |5 `+ i! F0 |: }! F
我记得有人说过并联之后会降低jitter值,除此以外还有其他的影响吗?6 ~3 N- H# X0 m" e7 U3 k& E0 {
输出的信号强度会不会有变化?
1 t. x) i) s$ I: @6 u5 p" R我指的是vrms的值,电压在并联之后会不会有所提升
2#
发表于 2007-12-10 14:46 | 只看该作者
好处啊,线路比较烂的DAC可以得到更高的信噪比啊、动态范围啊之类:p 5 V8 o* z3 o2 o+ _7 s* o3 X
前提是线路比较烂哦~
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3#
发表于 2007-12-10 14:46 | 只看该作者
不懂,来看答案:a)
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4#
发表于 2007-12-10 15:48 | 只看该作者
应该是THD吧。jitter是时序的问题,应该和DAC芯片无关。Vrms也不会有变,并联吗,一个2.6v和一个2.4v并一起不能得到5v的。同样,也不会是2.5。因为不管什么输出级,拉低和拉高的电流是不一样的,而且一般都还相差蛮大的,不过总归会靠近2.5一些,所以多少还是有些效果的。并联就像现在的SLI一样,实在是用了最好的芯片还不够才这样做,7600gt再怎么SLI也比不过8800ultra的。建议还是用一个好一点的芯片就行了。
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5#
发表于 2007-12-10 16:23 | 只看该作者
浅谈音频DAC的特殊用法
二、并联法3 d, D' D9 i+ E
并联使用DAC可提高等效比特数,提高转换精度,还原音乐的厚度感和力度感增强,在DAC的其他用法中,也可再施加此法,效果显著,因此它在高档机中获得了广泛的应用。
8 G6 x% q4 \2 Y# C
+ f; w& h# h* Y+ W8 w6 P" A- \- T( f0 \7 U& R  ?+ F$ g
原理见图2a)所示。nDAC并联同步工作,将nDAC输出的电流信号相加,再经过电流/电压(I/V)变换,输出模拟电压信号。
, }/ J9 |% n; A  R这种方法对小信号处理能力明显增强,等于增加了DAC的比特数。例如,218 bit DAC并联后的转换精度相当于19 bit420 bit DAC并联后转换精度相当于23 bit ,而820 bit DAC并联后转换精度相当于24 bit,等等。PCM170424 bit DAC出现之前,高档数字音响的24 bit转换精度就是利用多个DAC并联方法得到的。; w5 q: Z* ^8 A# [2 F- a
DAC并联使用时,信噪比、动态范围都会提高,而失真度将会减小,各种误差也被平均化而降低。! c' G- `# ~  u' s% u2 S
例如,对4个性能一致的20 bit DAC芯片进行并联实验,分别对1个、2个并联、3个并联、4个并联的信噪比(SNR)、总谐波失真(THD)、动态范围(DR)进行测试,测试的结果分别见图2b)、图2c)和图2d)所示。
2 C0 n0 V$ B3 t5 ~( f% S. J从图2b)的信噪比(SNR)特性测试图可以看出,随着DAC并联数目的增加,信噪比明显增加,由单个的115.8dB增加到2个并联的117dB3个并联的119.2dB4个并联的120.7dB
+ s) C5 _  O; F' T& r! Y从图2c)的总谐波失真(THD)特性测试图可以看出,随着DAC并联数目的增加,总谐波失真也有降低,由单个的0.0024%降低到2个并联的0.0019%3个并联的0.0016%4个并联的0.0014%0 I' j: K2 H5 z4 Z
从图2d)的动态范围(DR)特性测试图可以看出,随着DAC并联数目的增加,动态范围也在提高,由单个的100.5dB增加到2个并联的101dB3个并联的101.3dB4个并联的101.5dB6 ?3 B4 J9 [0 `9 j

( I8 P7 P" m2 k$ o. u6 K/ Y& t4 f* z- D( \/ i6 y6 B% N( ^

  v  u$ ~, K! |* u6 W详细内容可以去这里看看:
( }* i; h4 C- a5 chttp://www.audio-gd.com/audio/two/new_page_18.htm
# }+ y6 I# k, O7 x) chttp://www.go-gddq.com/html/2006-10/407373.htm  C+ ?2 Q6 }9 v" \% e- e

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6#
发表于 2007-12-10 16:34 | 只看该作者
原帖由 chairmanai 于 2007-12-10 16:23 发表 ) b! q2 N; \% ?6 M
浅谈音频DAC的特殊用法二、并联法6 Q* |3 O* a: h* H+ T  }0 _$ e+ G
并联使用DAC可提高等效比特数,提高转换精度,还原音乐的厚度感和力度感增强,在DAC的其他用法中,也可再施加此法,效果显著,因此它在高档机中获得了广泛的应用。
. T& H8 j8 v# R& q0 F+ X) Y; M& Z+ |/ T
812271: C! h% t1 Q) K" [
原理 ...
: {7 ?# N" Z$ W) T
audio-gd:rolleyes:
9 {# b& K  G: ?我就是请教了这个老板后才去尝试并联DAC的-_- 他比较空闲的时候还是很有耐性的:shifty:
* ~/ U/ Y" Z0 F" }
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7#
发表于 2007-12-10 16:37 | 只看该作者
原帖由 一生相随 于 2007-12-10 04:34 PM 发表
( E3 U& ~  f) u  f+ E) x
1 T. f% Y) v4 @' U# I& v9 Q( h6 y: @audio-gd:rolleyes: $ Z! F6 S4 Q2 z. A$ C( O
我就是请教了这个老板后才去尝试并联DAC的-_- 他比较空闲的时候还是很有耐性的:shifty:

  I' N( Y2 I! z% u% `, z5 t2 V7 |% A# P
他在土炮界也算小有名气了:lol:
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8#
发表于 2007-12-10 16:38 | 只看该作者
原帖由 chairmanai 于 2007-12-10 16:23 发表 : _2 E# [. v, @2 s" e( _% }
浅谈音频DAC的特殊用法二、并联法$ A* i+ F  R% n! a# d1 P# T
并联使用DAC可提高等效比特数,提高转换精度,还原音乐的厚度感和力度感增强,在DAC的其他用法中,也可再施加此法,效果显著,因此它在高档机中获得了广泛的应用。
$ I8 h! f; Q: G) m8 L6 \. u2 ^( s8 X
812271- L1 P7 T5 S2 B+ k- ~% c% O
原理 ...

( s4 V" L" d5 c就是搞不懂为什么会提高bit数。信号源就就是那么多bit,DAC哪里去自己加几个bit呢?除非信号源是高bit的,比如20bit。DAC是低bit的,比如18bit。那么信号源就可以分配四个不同的数据到四个DAC后并联取平均值。比如& H* K' T: ?0 J, L6 j( d8 Z
20bit:    000000000000000001 可以这么分配/ W& s# C  `' S" X6 [/ T
18bit_0: 0000000000000001$ [& C; u( p, ?0 n' Y. h7 W
18bit_1: 0000000000000000; w3 Q# p  N; J' Z
18bit_2: 00000000000000004 {8 v% h* [4 K2 _/ b3 [( G
18bit_3: 00000000000000002 U7 L7 _2 P0 t  P" }  a) [1 m1 r
这样就是20bit了,因为输入是不同的,所以输入不能并联起来,要做这个动作还是蛮复杂的,除非自己写FPGA来做,现成的IC一般都不会有这种功能。
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9#
发表于 2007-12-10 16:48 | 只看该作者
弄的越来越复杂了:sweatingbullets: 还是我的一托锡简单,就这样并了,引用别人的话:shifty: 谁用谁知道-_-
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10#
发表于 2007-12-10 16:51 | 只看该作者
其实提高bit数那一段我也看得不是一般纳闷:sweatingbullets:
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11#
发表于 2007-12-10 17:07 | 只看该作者
原帖由 chairmanai 于 2007-12-10 16:23 发表 ; C/ W/ w0 L5 R8 U# X  ]
浅谈音频DAC的特殊用法二、并联法! n9 ?6 I, h- b0 h
……
. w- t$ ]. G2 G2 o, [- g……
9 [% {3 q( W5 J3 ]' s例如,2个18 bit DAC并联后的转换精度相当于19 bit,4个20 bit DAC并联后转换精度相当于23 bit ,而8个20 bit DAC并联后转换精度相当于24 bit,等等……
  @6 _. `2 D! ^6 @" A& k( h
鸡蛋里挑点骨头:loveliness:   貌似应该是“4个20 bit DAC并联后转换精度相当于22 bit ,而8个20 bit DAC并联后转换精度相当于23 bit”
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12#
 楼主| 发表于 2007-12-10 18:03 | 只看该作者
看来并联的好处多多呀!:w00t):
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caojy 该用户已被删除
13#
发表于 2007-12-10 23:11 | 只看该作者
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14#
 楼主| 发表于 2007-12-11 10:55 | 只看该作者
原帖由 caojy 于 2007-12-10 23:11 发表
+ a  T, w3 L3 m5楼的回答是抄电子报的,还把它的错误一样抄来。
$ M0 H: L1 L5 n; V- S* z
什么错误?能不能说一下?
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15#
发表于 2007-12-11 12:23 | 只看该作者
原帖由 酷风 于 2007-12-11 10:55 发表
; r  C% V7 _0 h
* W; _  E9 N' F8 F9 }$ A% t7 E什么错误?能不能说一下?
9 t2 V+ u; @2 S3 P. u
貌似就是我11楼说的那个吧?:unsure:
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16#
发表于 2007-12-11 12:28 | 只看该作者
DAC 电路并联,没有一个好时钟 那基本就是劣化音质···
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17#
发表于 2007-12-11 12:40 | 只看该作者
提高比特数其实道理很简单,可以拿两个并联的情况来说明。6 F9 a) \* B* ]) W
" W) m. B3 d+ C; m& i
比如输入信号是17bit的,去掉符号位,为16bit,那么使用两个16bitDAC,用输入数据的符号位做数据选通信号,整数时送给一个DAC,负数时送给另外一个DAC,二DAC输出的参考分别接正负基准源,再用差分运放将两DAC的输出合成,那么就相当于用两个16bitDAC达到一个17bitDAC的精度了。
  a6 g3 t2 I" w8 f4 w' _
7 H9 z9 y+ d8 t/ t依次类推,合并两组这种结构,就有18bit精度~
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18#
发表于 2007-12-11 13:10 | 只看该作者
原帖由 gz0921 于 2007-12-11 12:40 发表 2 C" h" W2 t  X% c8 L$ h7 j
提高比特数其实道理很简单,可以拿两个并联的情况来说明。
* f- b5 t0 F) U+ Y8 _2 o3 O" ^9 l5 @1 S7 b$ J
比如输入信号是17bit的,去掉符号位,为16bit,那么使用两个16bitDAC,用输入数据的符号位做数据选通信号,整数时送给一个DAC,负数时送给另外一个DAC, ...
3 P8 u( m* b5 O4 G/ {+ [: \! V& ^
很大一部分的DAC都是串行总线的。所以去分割bit位不是加几个门电路就能解决的,要自己写FPGA。所以个人对提高比特数这个说法还是持保留态度。
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19#
 楼主| 发表于 2007-12-11 13:43 | 只看该作者
原帖由 HerculesVR 于 2007-12-11 12:28 发表
+ x/ [  P2 Q/ t8 mDAC 电路并联,没有一个好时钟 那基本就是劣化音质···

) l# F- q( h! u看来下一步就是要换个精度更高的晶振了……
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terryddb 该用户已被删除
20#
发表于 2007-12-11 14:25 | 只看该作者
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