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关于多DAC并联的一些问题,请高手解答

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1#
发表于 2007-12-10 14:36 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
在多DAC并联之后,会带来哪些好处?# A2 E& U9 V6 M% ^
我记得有人说过并联之后会降低jitter值,除此以外还有其他的影响吗?
* n4 Q8 l, K1 ]$ L& i7 W输出的信号强度会不会有变化?
( `! }; Z) F% a. H5 m我指的是vrms的值,电压在并联之后会不会有所提升
2#
发表于 2007-12-10 14:46 | 只看该作者
好处啊,线路比较烂的DAC可以得到更高的信噪比啊、动态范围啊之类:p
2 l( ~1 N# i$ ?8 I前提是线路比较烂哦~
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3#
发表于 2007-12-10 14:46 | 只看该作者
不懂,来看答案:a)
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4#
发表于 2007-12-10 15:48 | 只看该作者
应该是THD吧。jitter是时序的问题,应该和DAC芯片无关。Vrms也不会有变,并联吗,一个2.6v和一个2.4v并一起不能得到5v的。同样,也不会是2.5。因为不管什么输出级,拉低和拉高的电流是不一样的,而且一般都还相差蛮大的,不过总归会靠近2.5一些,所以多少还是有些效果的。并联就像现在的SLI一样,实在是用了最好的芯片还不够才这样做,7600gt再怎么SLI也比不过8800ultra的。建议还是用一个好一点的芯片就行了。
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5#
发表于 2007-12-10 16:23 | 只看该作者
浅谈音频DAC的特殊用法
二、并联法& Y  B; j/ Y% S: y( y; S
并联使用DAC可提高等效比特数,提高转换精度,还原音乐的厚度感和力度感增强,在DAC的其他用法中,也可再施加此法,效果显著,因此它在高档机中获得了广泛的应用。
( r/ d- b: H& k+ Y4 T& ]- ^9 }6 ]- Q/ M7 ^8 S

, c4 F4 |% z; l& y4 \0 `原理见图2a)所示。nDAC并联同步工作,将nDAC输出的电流信号相加,再经过电流/电压(I/V)变换,输出模拟电压信号。
/ S0 F5 E% h7 S这种方法对小信号处理能力明显增强,等于增加了DAC的比特数。例如,218 bit DAC并联后的转换精度相当于19 bit420 bit DAC并联后转换精度相当于23 bit ,而820 bit DAC并联后转换精度相当于24 bit,等等。PCM170424 bit DAC出现之前,高档数字音响的24 bit转换精度就是利用多个DAC并联方法得到的。
4 H6 y! m& H" \' O+ E( NDAC并联使用时,信噪比、动态范围都会提高,而失真度将会减小,各种误差也被平均化而降低。. r$ X' Q, B: {4 K8 q* |) z
例如,对4个性能一致的20 bit DAC芯片进行并联实验,分别对1个、2个并联、3个并联、4个并联的信噪比(SNR)、总谐波失真(THD)、动态范围(DR)进行测试,测试的结果分别见图2b)、图2c)和图2d)所示。
4 `( c9 d/ _3 o" [8 {从图2b)的信噪比(SNR)特性测试图可以看出,随着DAC并联数目的增加,信噪比明显增加,由单个的115.8dB增加到2个并联的117dB3个并联的119.2dB4个并联的120.7dB
7 p- k" c+ l% e4 e# c! ]2 K从图2c)的总谐波失真(THD)特性测试图可以看出,随着DAC并联数目的增加,总谐波失真也有降低,由单个的0.0024%降低到2个并联的0.0019%3个并联的0.0016%4个并联的0.0014%
8 C2 ?( M, _: g6 [) f从图2d)的动态范围(DR)特性测试图可以看出,随着DAC并联数目的增加,动态范围也在提高,由单个的100.5dB增加到2个并联的101dB3个并联的101.3dB4个并联的101.5dB
/ Q2 h9 Y. i, w' m) h6 s
1 ?/ F0 w; X- e& a1 G5 x) I$ }  t+ \
9 Q7 c. W* Q7 w: r
详细内容可以去这里看看:
9 Q( \- M$ y' yhttp://www.audio-gd.com/audio/two/new_page_18.htm* N8 B+ \" ]5 Q3 J
http://www.go-gddq.com/html/2006-10/407373.htm
: V$ \+ F5 X1 p% @  v( ~

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6#
发表于 2007-12-10 16:34 | 只看该作者
原帖由 chairmanai 于 2007-12-10 16:23 发表 8 d# B, r, K: l: x5 ~
浅谈音频DAC的特殊用法二、并联法
" q6 e% M3 d7 ~8 F' h并联使用DAC可提高等效比特数,提高转换精度,还原音乐的厚度感和力度感增强,在DAC的其他用法中,也可再施加此法,效果显著,因此它在高档机中获得了广泛的应用。
; z3 f1 ]1 j, x; A6 d
# k% t/ ~# \2 M7 b. X812271$ j7 k, e5 i( C
原理 ...

! s3 D9 g) A7 U' V" [8 [+ @audio-gd:rolleyes: $ b1 C# Z1 w. q& u' {
我就是请教了这个老板后才去尝试并联DAC的-_- 他比较空闲的时候还是很有耐性的:shifty:
* A  W9 R! s- w1 r8 N" R& C' g4 t
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7#
发表于 2007-12-10 16:37 | 只看该作者
原帖由 一生相随 于 2007-12-10 04:34 PM 发表
5 ?  n( U  x3 e9 e. U
) ?' ^$ }8 @/ C" B9 eaudio-gd:rolleyes:
. k' i1 b4 [+ R) C) s  E# J我就是请教了这个老板后才去尝试并联DAC的-_- 他比较空闲的时候还是很有耐性的:shifty:

! B; n8 P. t  v& L, U7 R  d% p; @" w$ B7 c4 R
他在土炮界也算小有名气了:lol:
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8#
发表于 2007-12-10 16:38 | 只看该作者
原帖由 chairmanai 于 2007-12-10 16:23 发表 & C4 M5 _/ ~( ~2 f/ G" m
浅谈音频DAC的特殊用法二、并联法
  I, z% ]2 O( y6 s2 s并联使用DAC可提高等效比特数,提高转换精度,还原音乐的厚度感和力度感增强,在DAC的其他用法中,也可再施加此法,效果显著,因此它在高档机中获得了广泛的应用。/ k1 f9 q2 h/ r" D
6 G" J, {. r1 N# ?( N$ H. _0 t) E
8122710 J. B+ X0 R# g: l8 \2 `
原理 ...
9 C6 \6 n7 p% I) S
就是搞不懂为什么会提高bit数。信号源就就是那么多bit,DAC哪里去自己加几个bit呢?除非信号源是高bit的,比如20bit。DAC是低bit的,比如18bit。那么信号源就可以分配四个不同的数据到四个DAC后并联取平均值。比如0 h! u& \" C3 ?- Q3 a% F
20bit:    000000000000000001 可以这么分配( X" T5 j9 ?- l, k, `) p
18bit_0: 0000000000000001
( N2 z! @% j1 u4 E: \8 m: _; B' [18bit_1: 0000000000000000+ y# G- J6 p3 g; O# J% w. ]
18bit_2: 0000000000000000: q" z* g1 z' A0 y8 K/ s
18bit_3: 00000000000000007 J) H" f) S3 N- @6 ?6 D( X
这样就是20bit了,因为输入是不同的,所以输入不能并联起来,要做这个动作还是蛮复杂的,除非自己写FPGA来做,现成的IC一般都不会有这种功能。
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9#
发表于 2007-12-10 16:48 | 只看该作者
弄的越来越复杂了:sweatingbullets: 还是我的一托锡简单,就这样并了,引用别人的话:shifty: 谁用谁知道-_-
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10#
发表于 2007-12-10 16:51 | 只看该作者
其实提高bit数那一段我也看得不是一般纳闷:sweatingbullets:
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11#
发表于 2007-12-10 17:07 | 只看该作者
原帖由 chairmanai 于 2007-12-10 16:23 发表 * {" a3 Z/ J. q3 v) ~0 A/ ~, V) ?
浅谈音频DAC的特殊用法二、并联法
# i7 k  [' e, O……
1 ~# M2 u/ a7 F% V7 \! J% j* X……* o  R. z7 g. E
例如,2个18 bit DAC并联后的转换精度相当于19 bit,4个20 bit DAC并联后转换精度相当于23 bit ,而8个20 bit DAC并联后转换精度相当于24 bit,等等……
1 }0 ~3 b% P0 }% O  u3 G
鸡蛋里挑点骨头:loveliness:   貌似应该是“4个20 bit DAC并联后转换精度相当于22 bit ,而8个20 bit DAC并联后转换精度相当于23 bit”
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12#
 楼主| 发表于 2007-12-10 18:03 | 只看该作者
看来并联的好处多多呀!:w00t):
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caojy 该用户已被删除
13#
发表于 2007-12-10 23:11 | 只看该作者
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14#
 楼主| 发表于 2007-12-11 10:55 | 只看该作者
原帖由 caojy 于 2007-12-10 23:11 发表
( m* Y# D& |% i3 t' C5楼的回答是抄电子报的,还把它的错误一样抄来。

8 Q  V0 o8 s) S, v4 c  Y/ W什么错误?能不能说一下?
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15#
发表于 2007-12-11 12:23 | 只看该作者
原帖由 酷风 于 2007-12-11 10:55 发表
/ Q0 c2 x" {& [$ ^( Q# N
; @; W5 d7 ^% a3 u. g7 G什么错误?能不能说一下?

  i& U8 F  \* F" W! `貌似就是我11楼说的那个吧?:unsure:
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16#
发表于 2007-12-11 12:28 | 只看该作者
DAC 电路并联,没有一个好时钟 那基本就是劣化音质···
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17#
发表于 2007-12-11 12:40 | 只看该作者
提高比特数其实道理很简单,可以拿两个并联的情况来说明。- @: w+ C/ m  |$ x
; w& ^+ q  F* ~; a3 k" Z3 f
比如输入信号是17bit的,去掉符号位,为16bit,那么使用两个16bitDAC,用输入数据的符号位做数据选通信号,整数时送给一个DAC,负数时送给另外一个DAC,二DAC输出的参考分别接正负基准源,再用差分运放将两DAC的输出合成,那么就相当于用两个16bitDAC达到一个17bitDAC的精度了。2 Z/ }+ k0 a: i$ H; Q

) b5 B: W& d9 Q; e# s% X: U3 R1 n依次类推,合并两组这种结构,就有18bit精度~
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18#
发表于 2007-12-11 13:10 | 只看该作者
原帖由 gz0921 于 2007-12-11 12:40 发表 , W7 ?0 t: K5 S) D$ `
提高比特数其实道理很简单,可以拿两个并联的情况来说明。
0 P, P' J5 n! A- ?1 v
: y- p: t& s5 A6 q( B比如输入信号是17bit的,去掉符号位,为16bit,那么使用两个16bitDAC,用输入数据的符号位做数据选通信号,整数时送给一个DAC,负数时送给另外一个DAC, ...
2 A/ ?+ h' ?: C# s
很大一部分的DAC都是串行总线的。所以去分割bit位不是加几个门电路就能解决的,要自己写FPGA。所以个人对提高比特数这个说法还是持保留态度。
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19#
 楼主| 发表于 2007-12-11 13:43 | 只看该作者
原帖由 HerculesVR 于 2007-12-11 12:28 发表
! f" |$ T+ a; E! _) R: ODAC 电路并联,没有一个好时钟 那基本就是劣化音质···
* i7 N; N+ W$ N, z
看来下一步就是要换个精度更高的晶振了……
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terryddb 该用户已被删除
20#
发表于 2007-12-11 14:25 | 只看该作者
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