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关于多DAC并联的一些问题,请高手解答

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1#
发表于 2007-12-10 14:36 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
在多DAC并联之后,会带来哪些好处?
2 g2 M( S' C  F8 K! X* i6 c我记得有人说过并联之后会降低jitter值,除此以外还有其他的影响吗?% U1 `$ X1 s) G9 L, F6 ~9 E+ p7 c
输出的信号强度会不会有变化?7 v* w* @$ T9 \+ B  H; C( K
我指的是vrms的值,电压在并联之后会不会有所提升
2#
发表于 2007-12-10 14:46 | 只看该作者
好处啊,线路比较烂的DAC可以得到更高的信噪比啊、动态范围啊之类:p   }  A: M: q  N( Y4 P/ Y4 C
前提是线路比较烂哦~
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3#
发表于 2007-12-10 14:46 | 只看该作者
不懂,来看答案:a)
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4#
发表于 2007-12-10 15:48 | 只看该作者
应该是THD吧。jitter是时序的问题,应该和DAC芯片无关。Vrms也不会有变,并联吗,一个2.6v和一个2.4v并一起不能得到5v的。同样,也不会是2.5。因为不管什么输出级,拉低和拉高的电流是不一样的,而且一般都还相差蛮大的,不过总归会靠近2.5一些,所以多少还是有些效果的。并联就像现在的SLI一样,实在是用了最好的芯片还不够才这样做,7600gt再怎么SLI也比不过8800ultra的。建议还是用一个好一点的芯片就行了。
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5#
发表于 2007-12-10 16:23 | 只看该作者
浅谈音频DAC的特殊用法
二、并联法( p  v) a7 \7 `6 L
并联使用DAC可提高等效比特数,提高转换精度,还原音乐的厚度感和力度感增强,在DAC的其他用法中,也可再施加此法,效果显著,因此它在高档机中获得了广泛的应用。! c" x( G  |+ m

% d/ L) ]9 v, I/ H
& x+ @+ o- E! a6 ~- t原理见图2a)所示。nDAC并联同步工作,将nDAC输出的电流信号相加,再经过电流/电压(I/V)变换,输出模拟电压信号。
. }) f* A- t4 C# i( @# A" \这种方法对小信号处理能力明显增强,等于增加了DAC的比特数。例如,218 bit DAC并联后的转换精度相当于19 bit420 bit DAC并联后转换精度相当于23 bit ,而820 bit DAC并联后转换精度相当于24 bit,等等。PCM170424 bit DAC出现之前,高档数字音响的24 bit转换精度就是利用多个DAC并联方法得到的。
: p/ p. N7 J2 O: qDAC并联使用时,信噪比、动态范围都会提高,而失真度将会减小,各种误差也被平均化而降低。* A$ z6 l4 W% x& A2 K
例如,对4个性能一致的20 bit DAC芯片进行并联实验,分别对1个、2个并联、3个并联、4个并联的信噪比(SNR)、总谐波失真(THD)、动态范围(DR)进行测试,测试的结果分别见图2b)、图2c)和图2d)所示。
2 C: X& q/ H& v3 f, h) |1 v从图2b)的信噪比(SNR)特性测试图可以看出,随着DAC并联数目的增加,信噪比明显增加,由单个的115.8dB增加到2个并联的117dB3个并联的119.2dB4个并联的120.7dB
( |5 {3 e5 `8 ^+ N# B5 x7 B  ~从图2c)的总谐波失真(THD)特性测试图可以看出,随着DAC并联数目的增加,总谐波失真也有降低,由单个的0.0024%降低到2个并联的0.0019%3个并联的0.0016%4个并联的0.0014%
! J9 o( J# [8 i从图2d)的动态范围(DR)特性测试图可以看出,随着DAC并联数目的增加,动态范围也在提高,由单个的100.5dB增加到2个并联的101dB3个并联的101.3dB4个并联的101.5dB3 [" {) [6 e* R( m2 w0 s
. h8 U  h- ~4 }# n' X! g0 q9 h. X0 ?
5 C& I- N$ M# K/ _

. U, ]% u8 x( v' E( F详细内容可以去这里看看:. v' B$ a2 S$ b$ R
http://www.audio-gd.com/audio/two/new_page_18.htm- b0 a& }  t1 j! I$ v. M# T
http://www.go-gddq.com/html/2006-10/407373.htm1 k# q' r2 Z/ e4 A5 w

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6#
发表于 2007-12-10 16:34 | 只看该作者
原帖由 chairmanai 于 2007-12-10 16:23 发表 : x9 \9 F- I4 j8 t3 k6 V+ w% g
浅谈音频DAC的特殊用法二、并联法
3 s) O: C4 Y, l0 b并联使用DAC可提高等效比特数,提高转换精度,还原音乐的厚度感和力度感增强,在DAC的其他用法中,也可再施加此法,效果显著,因此它在高档机中获得了广泛的应用。5 L9 w3 Y1 y+ @9 C
- a- j& y* N4 Q+ ?- c7 |+ {
812271/ J, X  p) s4 ?2 J
原理 ...
9 D  Y" z% ?5 K1 k- J
audio-gd:rolleyes: 7 F; j6 N+ x( u) R) A' z% x& S
我就是请教了这个老板后才去尝试并联DAC的-_- 他比较空闲的时候还是很有耐性的:shifty:
- H8 J5 b& B3 [9 Q& t5 D( s! L# X# Y
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7#
发表于 2007-12-10 16:37 | 只看该作者
原帖由 一生相随 于 2007-12-10 04:34 PM 发表
( u3 Z8 x8 Q; }6 Z: w7 B' `' e+ N" ^. t
audio-gd:rolleyes:
0 ~2 ^% Z9 V. a! P3 G我就是请教了这个老板后才去尝试并联DAC的-_- 他比较空闲的时候还是很有耐性的:shifty:
, m" k* |; d$ u: r( o

& n& W8 m; q2 J: B( L, ^: ~他在土炮界也算小有名气了:lol:
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8#
发表于 2007-12-10 16:38 | 只看该作者
原帖由 chairmanai 于 2007-12-10 16:23 发表
4 Z: N) E: R9 ?2 m, E浅谈音频DAC的特殊用法二、并联法
( W! \8 M1 A/ i- P4 P4 [并联使用DAC可提高等效比特数,提高转换精度,还原音乐的厚度感和力度感增强,在DAC的其他用法中,也可再施加此法,效果显著,因此它在高档机中获得了广泛的应用。. l' P! u: \( f3 U# X$ J: y

2 A1 P% ^1 b6 n" f6 M/ y6 V  k' k812271! G% I" r( N3 ?: H
原理 ...

& L/ Z& t- C2 q就是搞不懂为什么会提高bit数。信号源就就是那么多bit,DAC哪里去自己加几个bit呢?除非信号源是高bit的,比如20bit。DAC是低bit的,比如18bit。那么信号源就可以分配四个不同的数据到四个DAC后并联取平均值。比如, g  V2 s0 z' H: j' G* W% {, J
20bit:    000000000000000001 可以这么分配
# c8 v$ A+ C6 n% ?" p18bit_0: 0000000000000001* ]3 V5 D* K% r" Z5 |1 T4 ^8 \
18bit_1: 00000000000000008 ~" T, j" G1 _: x4 N9 c
18bit_2: 0000000000000000
: K5 {5 M6 Q* e/ e3 R18bit_3: 0000000000000000, t  _/ B7 l+ T3 b" M6 S( ^) g
这样就是20bit了,因为输入是不同的,所以输入不能并联起来,要做这个动作还是蛮复杂的,除非自己写FPGA来做,现成的IC一般都不会有这种功能。
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9#
发表于 2007-12-10 16:48 | 只看该作者
弄的越来越复杂了:sweatingbullets: 还是我的一托锡简单,就这样并了,引用别人的话:shifty: 谁用谁知道-_-
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10#
发表于 2007-12-10 16:51 | 只看该作者
其实提高bit数那一段我也看得不是一般纳闷:sweatingbullets:
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11#
发表于 2007-12-10 17:07 | 只看该作者
原帖由 chairmanai 于 2007-12-10 16:23 发表
& c# R2 d, z- b浅谈音频DAC的特殊用法二、并联法7 P5 k+ v+ B$ l8 ~. j( [1 N& i
……
6 T* L& r# _& n, T# p# ^- o8 _……3 w. u/ d4 O6 Z: C1 r
例如,2个18 bit DAC并联后的转换精度相当于19 bit,4个20 bit DAC并联后转换精度相当于23 bit ,而8个20 bit DAC并联后转换精度相当于24 bit,等等……

# S! o' m' r, W# |! }) v; t1 Y3 H鸡蛋里挑点骨头:loveliness:   貌似应该是“4个20 bit DAC并联后转换精度相当于22 bit ,而8个20 bit DAC并联后转换精度相当于23 bit”
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12#
 楼主| 发表于 2007-12-10 18:03 | 只看该作者
看来并联的好处多多呀!:w00t):
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caojy 该用户已被删除
13#
发表于 2007-12-10 23:11 | 只看该作者
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14#
 楼主| 发表于 2007-12-11 10:55 | 只看该作者
原帖由 caojy 于 2007-12-10 23:11 发表
- N7 }' L0 N) @2 h1 J; `% e! b8 i) v5楼的回答是抄电子报的,还把它的错误一样抄来。
+ u- K, g$ [3 |" C# S
什么错误?能不能说一下?
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15#
发表于 2007-12-11 12:23 | 只看该作者
原帖由 酷风 于 2007-12-11 10:55 发表
- F& L' \2 y7 v) Z/ }0 S3 O# b6 q4 T1 _: o& J, X
什么错误?能不能说一下?

- F2 U2 B9 C3 ^: Q4 C4 w貌似就是我11楼说的那个吧?:unsure:
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16#
发表于 2007-12-11 12:28 | 只看该作者
DAC 电路并联,没有一个好时钟 那基本就是劣化音质···
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17#
发表于 2007-12-11 12:40 | 只看该作者
提高比特数其实道理很简单,可以拿两个并联的情况来说明。
+ T7 z: c$ B6 f2 i8 R7 N# }# S7 v" z0 L1 B9 G" s
比如输入信号是17bit的,去掉符号位,为16bit,那么使用两个16bitDAC,用输入数据的符号位做数据选通信号,整数时送给一个DAC,负数时送给另外一个DAC,二DAC输出的参考分别接正负基准源,再用差分运放将两DAC的输出合成,那么就相当于用两个16bitDAC达到一个17bitDAC的精度了。+ c1 b& `/ _4 F" I- D& M

8 R- [2 Q/ K5 |+ u% w( K依次类推,合并两组这种结构,就有18bit精度~
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18#
发表于 2007-12-11 13:10 | 只看该作者
原帖由 gz0921 于 2007-12-11 12:40 发表 2 K9 T( A; S) m9 L4 y0 L1 r
提高比特数其实道理很简单,可以拿两个并联的情况来说明。, a; x7 x6 U% u/ e# d! C' B' W4 O

" |6 w# z8 t7 b  m0 {( a- H比如输入信号是17bit的,去掉符号位,为16bit,那么使用两个16bitDAC,用输入数据的符号位做数据选通信号,整数时送给一个DAC,负数时送给另外一个DAC, ...

" }5 n& g, B$ R2 I很大一部分的DAC都是串行总线的。所以去分割bit位不是加几个门电路就能解决的,要自己写FPGA。所以个人对提高比特数这个说法还是持保留态度。
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19#
 楼主| 发表于 2007-12-11 13:43 | 只看该作者
原帖由 HerculesVR 于 2007-12-11 12:28 发表
& p' M0 t5 D2 m# Y) ADAC 电路并联,没有一个好时钟 那基本就是劣化音质···

7 _1 W& Z& k' G* @9 R看来下一步就是要换个精度更高的晶振了……
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terryddb 该用户已被删除
20#
发表于 2007-12-11 14:25 | 只看该作者
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