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关于多DAC并联的一些问题,请高手解答

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1#
发表于 2007-12-10 14:36 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
在多DAC并联之后,会带来哪些好处?
- D3 y0 e4 _  q& Q6 `我记得有人说过并联之后会降低jitter值,除此以外还有其他的影响吗?; N+ B" |& L: i5 X
输出的信号强度会不会有变化?
0 f; r9 F) ^( f' k! @1 H' x! Q我指的是vrms的值,电压在并联之后会不会有所提升
2#
发表于 2007-12-10 14:46 | 只看该作者
好处啊,线路比较烂的DAC可以得到更高的信噪比啊、动态范围啊之类:p / V- j7 X) R9 u) N6 K
前提是线路比较烂哦~
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3#
发表于 2007-12-10 14:46 | 只看该作者
不懂,来看答案:a)
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4#
发表于 2007-12-10 15:48 | 只看该作者
应该是THD吧。jitter是时序的问题,应该和DAC芯片无关。Vrms也不会有变,并联吗,一个2.6v和一个2.4v并一起不能得到5v的。同样,也不会是2.5。因为不管什么输出级,拉低和拉高的电流是不一样的,而且一般都还相差蛮大的,不过总归会靠近2.5一些,所以多少还是有些效果的。并联就像现在的SLI一样,实在是用了最好的芯片还不够才这样做,7600gt再怎么SLI也比不过8800ultra的。建议还是用一个好一点的芯片就行了。
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5#
发表于 2007-12-10 16:23 | 只看该作者
浅谈音频DAC的特殊用法
二、并联法% X, i6 G9 {  Y) n2 A: U
并联使用DAC可提高等效比特数,提高转换精度,还原音乐的厚度感和力度感增强,在DAC的其他用法中,也可再施加此法,效果显著,因此它在高档机中获得了广泛的应用。( R6 [; H4 ?; X! Q$ x- ~- u

! f% \6 x. p/ c+ Q+ ?3 B7 v8 ?4 v+ c8 h& d: E9 T
原理见图2a)所示。nDAC并联同步工作,将nDAC输出的电流信号相加,再经过电流/电压(I/V)变换,输出模拟电压信号。$ M" _6 P* V$ ]3 j( Y
这种方法对小信号处理能力明显增强,等于增加了DAC的比特数。例如,218 bit DAC并联后的转换精度相当于19 bit420 bit DAC并联后转换精度相当于23 bit ,而820 bit DAC并联后转换精度相当于24 bit,等等。PCM170424 bit DAC出现之前,高档数字音响的24 bit转换精度就是利用多个DAC并联方法得到的。, F. s+ T. g3 C; m1 Z. O6 R
DAC并联使用时,信噪比、动态范围都会提高,而失真度将会减小,各种误差也被平均化而降低。
; c2 j1 V/ I5 ^5 G$ K例如,对4个性能一致的20 bit DAC芯片进行并联实验,分别对1个、2个并联、3个并联、4个并联的信噪比(SNR)、总谐波失真(THD)、动态范围(DR)进行测试,测试的结果分别见图2b)、图2c)和图2d)所示。. |: T. V! O0 W* E, X& D/ s
从图2b)的信噪比(SNR)特性测试图可以看出,随着DAC并联数目的增加,信噪比明显增加,由单个的115.8dB增加到2个并联的117dB3个并联的119.2dB4个并联的120.7dB
4 h" p1 `7 A2 ?( {从图2c)的总谐波失真(THD)特性测试图可以看出,随着DAC并联数目的增加,总谐波失真也有降低,由单个的0.0024%降低到2个并联的0.0019%3个并联的0.0016%4个并联的0.0014%7 h0 {1 R. y: r8 B% |
从图2d)的动态范围(DR)特性测试图可以看出,随着DAC并联数目的增加,动态范围也在提高,由单个的100.5dB增加到2个并联的101dB3个并联的101.3dB4个并联的101.5dB
4 @" _# Z! D) P) a5 K0 H) g+ |( R2 z8 U2 ?4 F3 w6 p
0 @: U3 D. E+ K( u

! o- i) R+ z7 U) K9 M6 p4 O详细内容可以去这里看看:
( @( I/ I8 U* `6 q0 o) vhttp://www.audio-gd.com/audio/two/new_page_18.htm
1 ~; h5 t7 }& U0 y7 G( ghttp://www.go-gddq.com/html/2006-10/407373.htm& ?3 ~% [2 _; }6 d( u1 ?, {: q$ c/ R

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6#
发表于 2007-12-10 16:34 | 只看该作者
原帖由 chairmanai 于 2007-12-10 16:23 发表 ! c2 z7 Q% i3 B. S! _1 u) V
浅谈音频DAC的特殊用法二、并联法& q! J8 S6 H. t+ M' [. X
并联使用DAC可提高等效比特数,提高转换精度,还原音乐的厚度感和力度感增强,在DAC的其他用法中,也可再施加此法,效果显著,因此它在高档机中获得了广泛的应用。5 n5 H2 y4 {! Q1 z3 ]. A! F) j: x( ^
! b( R5 w1 T: }6 E4 r$ Z
812271
( j# t* j$ G$ T+ R原理 ...
9 F7 u% D* f8 q9 n8 |+ N
audio-gd:rolleyes: ; ~: s% E3 z' Y( `2 O% p) d1 o
我就是请教了这个老板后才去尝试并联DAC的-_- 他比较空闲的时候还是很有耐性的:shifty:
: O- L* f( y# R; x) G* g
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7#
发表于 2007-12-10 16:37 | 只看该作者
原帖由 一生相随 于 2007-12-10 04:34 PM 发表
! i! j/ y! e" F& {8 M# Z% V: F5 _2 O$ W+ ^7 U+ \% z
audio-gd:rolleyes: 3 J- v6 p2 a3 k+ b) P  T; R
我就是请教了这个老板后才去尝试并联DAC的-_- 他比较空闲的时候还是很有耐性的:shifty:

! g$ f3 x5 b: k" `+ `2 h# J0 B( G2 H" i; b
他在土炮界也算小有名气了:lol:
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8#
发表于 2007-12-10 16:38 | 只看该作者
原帖由 chairmanai 于 2007-12-10 16:23 发表 / W) S4 b/ G9 n6 ?4 w. B
浅谈音频DAC的特殊用法二、并联法  C6 {& n" W) V# Z; V$ P
并联使用DAC可提高等效比特数,提高转换精度,还原音乐的厚度感和力度感增强,在DAC的其他用法中,也可再施加此法,效果显著,因此它在高档机中获得了广泛的应用。
; E( Z1 E( e' u* @2 m; i1 @5 X9 W+ ]& [5 Y
812271, @" C& {1 Y' r& y6 ?7 {' [
原理 ...

( p$ E( h. \) h+ x就是搞不懂为什么会提高bit数。信号源就就是那么多bit,DAC哪里去自己加几个bit呢?除非信号源是高bit的,比如20bit。DAC是低bit的,比如18bit。那么信号源就可以分配四个不同的数据到四个DAC后并联取平均值。比如/ i1 H% v$ ?1 o1 C6 }+ b6 X$ G
20bit:    000000000000000001 可以这么分配' ~3 V4 s' X5 v) r' j/ b; p$ T
18bit_0: 0000000000000001
. [; I* c$ I' t7 q0 a5 ]+ z2 H6 s18bit_1: 0000000000000000
8 S+ k* x& M% b6 M* V18bit_2: 0000000000000000% O$ H. J/ ~0 X, O& A6 C) L& L
18bit_3: 0000000000000000/ G1 O( G8 S* |# U3 L
这样就是20bit了,因为输入是不同的,所以输入不能并联起来,要做这个动作还是蛮复杂的,除非自己写FPGA来做,现成的IC一般都不会有这种功能。
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9#
发表于 2007-12-10 16:48 | 只看该作者
弄的越来越复杂了:sweatingbullets: 还是我的一托锡简单,就这样并了,引用别人的话:shifty: 谁用谁知道-_-
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10#
发表于 2007-12-10 16:51 | 只看该作者
其实提高bit数那一段我也看得不是一般纳闷:sweatingbullets:
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11#
发表于 2007-12-10 17:07 | 只看该作者
原帖由 chairmanai 于 2007-12-10 16:23 发表 / Q% J5 k$ c# T6 T6 w# U; k
浅谈音频DAC的特殊用法二、并联法
2 ^  F6 Y" G/ O- }……: @8 L. e9 @" h" @
……
) O" c9 G$ @- t0 K例如,2个18 bit DAC并联后的转换精度相当于19 bit,4个20 bit DAC并联后转换精度相当于23 bit ,而8个20 bit DAC并联后转换精度相当于24 bit,等等……
; J5 Q6 ]) B' D
鸡蛋里挑点骨头:loveliness:   貌似应该是“4个20 bit DAC并联后转换精度相当于22 bit ,而8个20 bit DAC并联后转换精度相当于23 bit”
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12#
 楼主| 发表于 2007-12-10 18:03 | 只看该作者
看来并联的好处多多呀!:w00t):
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caojy 该用户已被删除
13#
发表于 2007-12-10 23:11 | 只看该作者
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14#
 楼主| 发表于 2007-12-11 10:55 | 只看该作者
原帖由 caojy 于 2007-12-10 23:11 发表 / S. {$ B7 X" G) Y& F
5楼的回答是抄电子报的,还把它的错误一样抄来。
& E, I( h1 K/ S! v
什么错误?能不能说一下?
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15#
发表于 2007-12-11 12:23 | 只看该作者
原帖由 酷风 于 2007-12-11 10:55 发表
7 j! P; o8 m5 ]7 M, y; z. y3 d0 C7 i8 ?7 T
什么错误?能不能说一下?

- T4 T5 Z7 S$ R貌似就是我11楼说的那个吧?:unsure:
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16#
发表于 2007-12-11 12:28 | 只看该作者
DAC 电路并联,没有一个好时钟 那基本就是劣化音质···
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17#
发表于 2007-12-11 12:40 | 只看该作者
提高比特数其实道理很简单,可以拿两个并联的情况来说明。
+ y; U' K, F0 N- b* e+ o$ K% ]3 P; ?, h7 x9 O1 ^0 g0 t
比如输入信号是17bit的,去掉符号位,为16bit,那么使用两个16bitDAC,用输入数据的符号位做数据选通信号,整数时送给一个DAC,负数时送给另外一个DAC,二DAC输出的参考分别接正负基准源,再用差分运放将两DAC的输出合成,那么就相当于用两个16bitDAC达到一个17bitDAC的精度了。) E5 U; ~* F' m, ]+ g( _

+ d7 q) t9 w8 T8 E( B依次类推,合并两组这种结构,就有18bit精度~
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18#
发表于 2007-12-11 13:10 | 只看该作者
原帖由 gz0921 于 2007-12-11 12:40 发表 7 C! `3 L" G7 l; X( W
提高比特数其实道理很简单,可以拿两个并联的情况来说明。$ x, r. [4 y  R, L3 D0 S9 \
% k( t8 D0 ]! n# h! C( G
比如输入信号是17bit的,去掉符号位,为16bit,那么使用两个16bitDAC,用输入数据的符号位做数据选通信号,整数时送给一个DAC,负数时送给另外一个DAC, ...

$ J$ m1 v. s* W5 v# j% h/ U2 V0 Q很大一部分的DAC都是串行总线的。所以去分割bit位不是加几个门电路就能解决的,要自己写FPGA。所以个人对提高比特数这个说法还是持保留态度。
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19#
 楼主| 发表于 2007-12-11 13:43 | 只看该作者
原帖由 HerculesVR 于 2007-12-11 12:28 发表
) U& }& x9 t; w7 E7 xDAC 电路并联,没有一个好时钟 那基本就是劣化音质···
6 J7 _# k; w0 \0 u6 Y
看来下一步就是要换个精度更高的晶振了……
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terryddb 该用户已被删除
20#
发表于 2007-12-11 14:25 | 只看该作者
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